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MICROPROCESSOR BASED, PC INTERFACED MULTI-LANGUAGE LED MATRIX DISPLAYThesis
submitted in partial fulfillment of the requirement for the Bachelor of Science
degree in Electrical Engineering. By:1. LEALEM GIRMA---------------Reg/550/96
2. SISAY AWOKE-----------------Reg/56 6 /96
3. SOLOMON BAHIRU----------Reg/56 7/96
4. TILAHUN MELKA-------------Reg/57-/96 Advisor: GASHAW AYALEW
(M. Sc)
Co-Advisor: To:
Department of Electrical Engineering,
Engineering Faculty,
Arba Minch University,
P. o. Box 21
Arba Minch,
Ethiopia.
June 2007DeclarationThis is to certify that undergraduate thesis entitled
MICROPROCESSOR BASED, PC INTERFACED MULTI-LANGUAGE LED MATRIX DISPLAY Which is
submitted by us in partial fulfillment of the requirement for the award of degree
B. sc in Electrical Engineering to Engineering Faculty, Arba Minch University, Arba
Minch, Ethiopia comprises only our original work and due acknowledgment has been
made in the text to all other material used. Date:Name of student
Id
Signature of student
1. Lealem girma
Reg/550/96 2. Sisay Awoke
Reg/56 6 /96 3. Solomon Bahiru
Reg/56 7/96 4. Tilahun Melka
Reg/57-/96 APPROVED BY:Ato GASHAW
AYALEW (M. sc)
Ato (B. sc)
Lecturer
lecturer
Electrical Engineering Department
Arba Minch UniversityCertificateThis is to certify that Undergraduate thesis
entitled MICROPROCESSOR BASED, PC INTERFACED MULTI-LANGUAGE LED MATRIX DISPLAY By
Lealem girma,
Sisay Awoke, Solomon Bahiru and Tilahun Melka has
been submitted in partial fulfillment of the requirement for the award of B. sc
degree in Electrical Engineering to Engineering Faculty Arba Minch University, Arba
Minch, Ethiopia. Date: June 21 2007Zelalem Girma (M. Sc)Head, Electrical Engineering
DepartmentArba Minch University
Acknowledgements
A number of individuals have contributed to the
preparation of this project. The project members acknowledge the contribution of
each one of them. The project members would like to express their thanks and
appreciation to their advisor, Ato Gashaw Ayalew for contributing in various ways
for the completion of this project.
Finally, Our heartfelt thanks to Ato
Lealem Girma, Head of Electrical Engineering, for providing materials and
suggestions. ABSTRACT
The principal objective of this
project is to design and implement a computer interfaced LED matrix display along
with functional software for user interface and utilizing a serial communications
protocol linking the computer to the device.
The device is
composed of a microcontroller unit having a microprocessor module (8088
microprocessor) with memory and input/output ports along with a serial
communication controller (USART) to interface it with the computers RS-232 serial
port.
The project directly addresses the problem of low cost
public messaging systems that are flexible and more functional which the designer
believes are in much need in the current advertising market of the country.
Another usefulness of the project would be in demonstrating the superior
functionality of microprocessor based systems in contrast to completely hardware
based systems as well as the greater flexibility gained by interfacing a functional
hardware with a computer as a source of data and instruction.
PART ONE
GENERAL INTRODUCTIONGENERAL INTRODUCTION1. MICROPROCESSORS AND VISUAL
PRESENTATION
SYSTEMS
Microprocessor unitsA microcontroller is an entire computer on a smaller scale with
application specific features. At the center of its architecture is the

microprocessor or the CPU. The CPU (central processing unit) as its name implies,
performs all the required arithmetic, logical or transfer processes according to
instructions which are stored in and supplied to it from a memory storage unit.
Basically all microprocessors have the same internal architecture. It consists of
address & instruction as well as data temporary stores known as registers,
arithmetic and logic processing unit (ALU) and control unit (CU). The control unit
generates all the bus control signals necessary for internal as well as external
coordination of data flow. A block diagram of a typical CPU internal structure is
shown in fig. 1. 1. During operation the CPU asserts the various control signals and
data as well as address signals to access the memory and input output units and
fetch or output data. Each of these steps needs a unitary synchronizing mechanism
which is supplied by a clock signal which keeps all system timing. The complete
bus assertion , instruction fetch, data acquisition and processing coordination put
graphically in contrast to the common clock signal timing is known as machine cycle
timing diagram for the particular processor. A typical one is show in fig. 1. 2. #
Fig. 1. 1 A typical internal architecture of CPUs. # EMBED Word. Picture. 8 ###Fig1. 2
Machine cycle timing diagram of the typical microprocessor2. INTRODDUCING THE INTEL
8088 MICROPROCESSORIntel 8088 microprocessor is compatible with 8086 software and
it accepts all hardware devices that are compatible with 8085 microprocessor. All
its features are similar to 8086 except that it is 8-bit. The unique feature of
both 8088 and 8086 is the use of an instruction pre-fetch queue. This is a 4 byte
(6 bytes in 8086 ) first in, first out storage area in the BIU used to save
instructions that are pending execution in the EU. All the peripheral interface
schemes with 8088 are now exactly similar to 8085 schemes except for the increased
memory and I/O capabilities. The 8088 microprocessors have a 1Mbyte memory and a 6 4
Kbytes I/O capabilities. For the construction of this project the intel-8088 was
implemented. As an 8 bit processor there were several technical as well as
conventional criteria for its choice among its peers. Some are: -Availability of
supporting peripheral devices. Most popular processors have their own range of
supporting peripherals like parallel and serial I/O controllers. In the case of
this project among the CPUs available only the intel8088 has most of the peripheral
devices required like the serial communication controller (8251A) and timer unit
(8253)Clock input. Unlike the 8085 the 8088 does not need a separate clock generator
IC (the 8224) and unlike the 8080 it does not require two input pins to attach a
crystal to. This leaves the 8088 with a single clock input pin, which gives the
freedom of utilizing any convenient clock generator. In particular this project
needed the use of lower frequency clock, which is generated with accurate wave
shape by a simple 555 timer IC square wave generator. Power supply. 8088 has only a
+5v to GND power input, which eliminates the use of two or more separate power
supplies. Bus structure. The bus structure of the 8088 is more straightforward than
that of either the 8080 or
the 8085. Both I/O and memory request lines and read
write signals are available on the package which can easily be decoded using a
single 74 LS/HC 32 IC to generate the various control signals required. Interrupt
priority structure. For multiple interrupt requiring devices the unlike 8085, INTEL8088 has two interrupt pins, viz. NMI and INTR. The NMI is a nonmaskable interrupt
input pin. This means that any interrupt request at NMI input cannot be masked or
disabled at any means. The INTR interrupt, however, may be masked using interrupt
flag (IF). If more than one type of INTR interrupts occurs at a time, then an
external chip called PIT is required to handle them. VISUAL PRESINTATION SYSTEMSAt
the usable end of every digital system or equipment are analog devices to give
human interpretable outputs. In general all digital systems communicate to the
analog world in some way utilizing a form of presenting device. Visual presentation
systems give interpretations of the results of a system process in a form
perceivable to the human eye. Electronic displays range in complexity from simple
enunciators (ON OFF lights) to graphic displays utilizing cathode ray tubes
(CRTs). A wide range of technologies is used to implement and control display
devices. Each technology has advantages and disadvantages with respect to density
of information displayed, power consumption, reliability, and ease of use. The
visible portion of a display is comprised of an arrangement of light emitting or

light modulating elements. The physical arrangement of display elements is called

a display font. The font determines what characters can be displayed. Some common
display fonts are shown below. # EMBED Word. Picture. 8 ###Fig . 1. 3 Types of display
fonts. Fonts with 7 elements are capable of displaying decimal and hexadecimal
numeric characters. Dot matrix fonts, such as a 5x7 matrix, can display numeric,
alphabetic, and some symbolic information. Graphic displays have a large number of
elements (called picture elements or pixels) and can display pictorial information
with high resolution. They can be thought of as very large dot matrix displays. As
the number of displays in a display increases, so does the complexity of the
electronics necessary to control the display. Three popular low density displays
are: LED displays; liquid crystal displays (LCDs); and vacuum fluorescent displays
(VFDs). From these three the LED type display was implemented in the project and
will be discussed in brief. 3. 1
LED displays. Al operating life of more than
100,000 hours. LEDs are available as single devices or packaged together in various
fonts for displaying binary, numeric, and alphanumeric information. The voltage drop
of a forward biased LED is essentially fixed, typically 1. 6 or 2. 4V. Usually a
resistor is used to limit the current to the desired value. For DC operation, the
nominal operating current is typically 20m A for standard red LEDs and 10 m A for
high efficiency red LEDs. Some low current LEDs can operate at a current of 1mA.
One of the simplest display technologies is the light-emitting diode (LED). LEDs
are solid-state devices, p-n junctions that emit light when stimulated by a low
voltage direct current. LEDs can be designed to emit light with wavelengths from
ultraviolet, through the visible spectrum, to infrared. The most efficient LED is
the visible spectrum and emits red light. While red is the most commonly color for
LED displays, yellow, green, and blue LEDs are also available. LEDs are popular
display devices because they can be operated from low voltages, are compatible with
systems that use ICs, are small, lightweight, and mechanically rugged. As solidstate devices, they are highly reliable and have a typical# EMBED PBrush ###
Fig1. 4. Forward biasing of a light emitting diode. RATIONALE FOR THE PROJECT
Although display systems are far from being a recent development, for the most part
of their history they had been restricted to analog technology. Conventional CRTs
in television systems are completely analog devices apart from recent
standardization of digital controls for processing their various signals. Digital
display systems, matrix type displays in particular, have gained a huge interest in
recent years. The advantage obtained by combining the almost limitless flexibility
of digital systems and the direct binary data compatibility and power saving
capability of matrix type displays proved too inviting to avoid. A unique feature of
this design is not only that it is interfaced to a computer but makes use of
windows based fonts by directly converting them to bitmap format and transmitting
the binary equivalent of each column in ASCII code. This approach is well suited
especially for systems that are not text oriented, and works with both text and
graphics as if they were a form of bitmapped image. An obvious advantage of this is
the accommodation of any font or text style that is registered into the computers
(windows) registry. This opens the door for displaying Geez (ETHIOPIC) characters
if they are available (loaded) in the interfaced PC. Thus the project focuses on a
low cost method for displaying any font including Geez, without having to build
complicated software that generates the characters or a hardware system that is
capable of recognizing characters at all. The interfacing scheme uses a serial
interface of simplex transmission utilizing the EIA RS-232 serial ports available
in almost all computers in market today. The serial transmission gives it the
advantage of being capable of a longer distance connection both cost wise and in
terms of noise immunity. 5. GENERALIZED BLOCK DESCRIPTION OF THE DESIGN#Fig. 1. 5 A
generalized block description of the project showing the various interfacing units
& the MTS-88 kit6 . PROJECT VALIDATION AND AREAS OF APPLICATION. Graphic public
addressing systems have for some time now become the standard. Earlier display
systems featuring simple hexa-numeric fonts had been popular in most control
panels, outdoor displays, measurement systems and personal computing equipment.
Matrix type display systems, when became the standard, gave a greater flexibility
in conveying a more customized and figurative information. Various kinds and sizes

of fonts could be displayed with the advantage of having control over a more number
of pixels. When combined with microcontroller-based drivers these displays could be
exploited to the maximum level of their flexibility. Furthermore, interfacing
offered the use of the ultimate computational power and ease of use of the
computer. Once command has been transferred to the computer, as the source of data
and/or instruction a greater level of functionality would be obtained due to the
ease of use and re-programmability of PC based software. In fact microcontroller
based and computer interfaced digital display systems have long been used in large
public centers and advertisement panels. But these systems, in the views of the
designer of this project, had several shortcomings of which two of the most
important are: -They mostly utilize hardware based font tables with a memory unit
Keeping the database and a microcontroller to access it as per a command from the
interface in ASCII format. This approach completely cancels out the possibility of
custom defined fonts and other graphics. Since the standard (5x7 or more) matrix
fonts are designed for English or Japanese characters this would leave out the
chance of accommodating minority fonts like Geez. All are based on specifically
designed microcontroller chips rather than discrete ICs so that it would require a
great effort to customize those to local needs. Also the controller chips tend to
be very costly and not affordable in local terms. Hence the designer believes low
cost display systems that are more customizable with easier PC based user interface
could gain popularity in all public addressing and process control areas given
their affordability and modifiability to the specified task.
PART TWO
HARDWARE DESIGN
HARDWARE. INTRODUCTION2. 1 DESIGN
PRECONDITIONSA.
Digital signals.
The CPU module shown in fig clearly
illustrates the three-bus architecture of the typical processor. The 16 lines of
the address bus are labeled
A0 (least significant bit) through A15 (most
significant bit). Similarly, the 8 lines of the data bus are loaded D0 through D7.
The 4 lines of the control bus are defined to be consistent with the four types of
machine cycles introduced in section 1. 1 (I/O read and write and memory read and
write). Most microprocessors and digital circuits provide signal levels that are
transistor-transistor-logic (TTL) compatible. In this system, any voltage level
less than or equal to 0. 4V is considered a logic 0. Logic 1 is defined as a voltage
level greater or equal to 2. 4V. Typical values are 0. 2V and 3. 4V. Note that a TTL
receiver is designed to accept voltages as high as 0. 8V for logic 0 and as low as
2. 0V for logic 1. Another popular logic family is complementary metal oxide
semiconductor (CMOS), devices that produce typical logic levels of 0V and 5V. In
most cases, TTL devices can drive a nearly unlimited number of CMOS devices
(provided that pull up resistors are used to bring TTLs logic 1 level closer to
5. 0V), but CMOS devices are limited to one standard TTL load. The idealized square
waves usually drawn (with 0 rise and fall times and perfectly squared edges) are
not realized in practice. Interfacing slower devices.
Usually, the speed of a
I/O device is measured by considering its address access time (or simply, access
time). The 8088 processor gives slow access time before it latches or gates the
value on data bus, meaning that it will not have enough time to decode the memory
address and gate the proper data byte onto the data bus. Since nothing can be done
to speed up the I/O device The only option left is to slow down the processor. This
can be done using two Popular methods, which are: -1.
Using a slower system clock
to accommodate the slowest device in the circuitImplementing a wait state generator
to request a wait period until the device is ready. 2.
The later method is a more
efficient approach, especially for systems that require Speed such as complex
mathematical operation performing equipment, since the System slows down only when
it accesses the slower devices rather than throughout its operation. . 2. 2. SERIAL
INTERFACING2. 2. 1 THE EIA RS-232 SERIAL INTERFACEFirst published in 196 9, it was
intended to describe the interface between a computer terminal and a modem. In RS232 terms the word DTE (data terminal equipment) means the terminal computer and
DCE (data communications equipment) refers to the modem. The RS-232 specifications
limit the data rate to 19,200 bps with a 50-foot cable. In practice, much longer
cables can be accommodated, but at lower data rates. RS-232 is a voltage standard
with typical logic levels of -12V for a logic 1 and +12V for a logic 0. Standard

TTL uses positive logic and provides 0. 4V of noise immunity. RS-232 is quite
different: it uses negative logic with typical output levels of +12V. The higher
voltages are necessary to ensure reliable operation
with long cables. A 2V noise immunity specification allows the cables to be routed
through noisy environments that would be a problem for TTL. In order to interface
RS-232 with TTL, special line drivers and receivers are required. The MC1488 (or
equivalent) accepts TTL-level inputs and provides RS-232 output levels. The MC1489
does the opposite, converting the RS-232 levels on the transmission line to TTL
levels for the receiving device (in the case of this project the 8088 USART). 2. 4. 2
SIGNAL DESCRIPTION OF THE RS-232When RS-232 was developed, six active-low (+12V)
signals were defined to control the transfer of data between a terminal (DTE) and a
modem (DCE). The definitions of each signal are as follows:DCD:
(data carrier
detect) output by the DCE and indicates that theModem has detected a valid carrier
from a remote site. DTR:
(data terminal ready) output by the DTE to indicate that
it isPresent and ready for communications. DSR:
(data set ready) output by the
DCE in response to DTE. RTS:
(request to send): output by the DTE to indicate
that it is ready toTransmit data. CTS:
(clear to send): this signal is output by
the DCE and acknowledgesRTS. It indicates that the DCE is ready for transmission.
RI:
(RING) output by the DCE (modem) and is active in synchronismWith the
telephone line signal2. 4. 3 MECHANICAL INTERFACE OF THE RS-232 (DB 9 CABLE)# EMBED
PBrush ###Fig2. 1 pin out of RS-232 cableIMPORTANT TERMS2. 3. 1 The 8088
microprocessor. The processor in the design (intel8088) is an 8-bit CPU available
in three clock rates that is 5MHZ, 8MHZ, 10MHZ packaged in a 40 pins CERDIP or
plastic package. 8088 operate in a single processor or multi-processor to achieve a
high performance. Some of the pins serve a particular function in a minimum mode (or
single processor mode) and others function in maximum mode (multiprocessor mode)
configuration. The terms we have found new from that of our knowledge of 8085
processor are listed below. TEST: this input is examined by a WAIT instruction if
it goes LOW execution will continue else the processor remains in idle state
#MN/MX: the logic level at this pin decides whether the processor is to operate in
either minimum (single processor) or maximum (multiprocessor) mode. #LOCK: this
output pin indicates that other system bus masters will be prevented from gaining
the system bus, while the LOCK signal is low. #2. 3
CIRCUIT DESCRIPTIONS2. 3. 1
CLOCK GENERATORIn every microprocessor based device the operations done by the CPU
need common system timing in order to harmonize the various external and internal
processes. A clock generator device usually employing a crystal oscillator provides
this system-timing signal. The 8088 CPU module shown in fig. 2. 1 also demonstrates a
commonly used clock generator circuit using a crystal, a single 74HC04 inverter IC
and some passive components to start the crystal to oscillate. The crystal type
square wave generator is most of the time employed for systems that require higher
clock speeds (in the MHZ range), since only crystal based oscillators can generate
frequencies up to this range. The project design, however, is based on system clock
frequency in the higher MHZ range (about 6 MHZ). Hence a crystal based clock
generator was not found a necessity in the design. A disadvantage of the crystal
based oscillator is that it does not output a fairly shaped square waveform most of
the time. This specially is a problem in high frequency operations because of the
stray and junction capacitances created. Another shortcoming of the crystal
oscillator is that it requires a crystal, which is most of the time found with
values of common needs. Thus we cannot modify the clock rate to our needs but
rather the design itself might need modification to adjust for the available clock
rate determined by the crystal. Thus it was desired to design the system with
another type of square wave generator, which was decided on a 555 timer IC. The
device setup and output waveforms are shown below: -# EMBED Word. Picture. 8 ###
Fig. 2. 2.
the 555 timer connected for a stable operation to generate the necessary
main system clock. Thus the 555 timer was found to provide a good result in terms of
wave shape and stable operation which are necessary parameters for reliable system
performance. The output frequency can be easily calculated using the following
derived formula: -# EMBED PBrush ###Thus for a system clock speed of 6 MHZ, with
the values of
Ra and
Rb chosen as
5000 ( and 1000 ( respectively, the

value of the capacitor C can be found easily with : -Thus a 0. 001 (F capacitor
should give a good approximate result. Apart from the main system clock there also
exists another clock generator in the design with a much lower clock speed (about
19,6 00 Hz) and having a purpose of supplying the baud rate clock for the serial
communication device (8251A USART). The component selection and frequency results
will be discussed in later sections dealing with the device. 2. 4 SERIAL INPUT
/OUTPUT INTERFACING2. 4. 1 OVERVIEWAll microcomputer input /output fall under one of
two broad categories: serial or parallel. In parallel port at least 11-condctor
cables are required. The parallel port also tends to be hardware specific, with the
result that a parallel port on computer may not be compatible with a parallel port
on an other computer. A serial I/O port transmits each data byte bit by bit. The
immediate advantage of this technique is that only two conductors are used: the
signal wire and ground unless and otherwise it is full duplex in which case three
wires is allowed. Of course, we decide how long each bit will persist and what
order of the bits will be. These rules are referred to as the serial
communication protocols. As you might imagine, several different protocols have
been developed over the years. The obvious penalty with a serial I/O port is a
significant reduction in the data transfer rate. The most popular serial standard,
EIA RS-232, restricts the data rate to less than 2000 bytes per second and cable
length to less than 50 ft. newer (and faster) standards have been proposed, but
have not gained the RS-232 popularity. Despite this disadvantage, serial
communication and RS-232 standards in particular have become widely accepted. One
of the reasons is the definition by the EIA committee of a standard serial port.
By defining the protocol, users can be sure of compatibility between their
equipments and an RS-232 serial port. Another powerful feature of serialized data is
that such data can easily be converted to audio tones and transmitted over the
switched telephone network. This is done with a modem and allows communication
between computer equipment thousand of miles apart. ASYNCHRONOUS SERIAL
COMMUNICATIONSOne of the most common applications of serial I/O port is the
interface of a keyboard on a video display terminal. In this circuit, each
keystroke generates the seven bits ASCII code that is converted to bit by bit
serial form and then transmitted to a computer over a two or three conductor cable.
Note an important characteristics of this interface: at some times the serial ports
will be required to transfer data at 10 to 20 characters per second, but at other
times a data rate may be 1 or 2 characters per second. Indeed, most of the time the
keyboard is not in use and the data rate is zero. Because of this erratic data
rate, an asynchronous communication protocol must be established. The accepted
technique for asynchronous serial communication is to hold the serial output line
at logic 1 level (called mark) until data is to be transmitted. Each character is
required to begin with logic 0(called space). This character is called the start
bit and is used to synchronize the transmitter and receiver. The data is sent least
significant bit first and framed between the start bit (always a 0) and one or two
stop bits (always a 1). The start and stoop bit carry no information, but are
required because of the asynchronous nature of the data. The data rate can be
expressed as bits per second or characters per second. The term bits per second
is also called as baud rate. This value in our project is about 6 00. 2. 4. 2 STANDARD
ASYNCHRONOUS SERIAL COMMUNICATIION PROTOCOLAs we have mentioned previously,
protocols define certain rules that should be followed to help standardize the
communication technique. An example is the adoption of a 0 start bit and logic 1
stop bits. In setting up serial port, several parameter must be specified, the most
common of which are as follows. Data bits per character, usually 5to 8Stop bits, one
or twoParity bits, used to detect single bit errorBaud ratIntel 8251A is a
universal synchronous asynchronous receiver transmitter compatible with Intel
processors. This may be programmed to operate in any of the serial communication
mode built in to it. This chip converts the parallel data into serial stream of
bits and converts it into parallel data bytes to be read by microprocessor. 2. 4. 3
Architecture and signal description of 8251The architectural block diagram of 8251
followed by functional description of each block is shown below. Figure2. 3The data
buffer interfaces the internal bus of the circuit with the system bus. The read

write controller logic controls the operation of the peripheral depending on

operations initiated by the CPU. This unit also selects one of the two internal
addresses. Those are control addresses and data addresses at the behest of the C/D
signal. The modem control unit handles the modem handshake signal to coordinate the
communication between modem and USART. The transmit control unit transmit the data
byte received by the data bus buffer from the CPU for further serial communication.
This decides the transmission rate which
is controlled by TXC input frequency. This unit also derives two transmitted
status signal namely TXRDY and TXEMPT. These may be used by the CPU for
handshaking. The transmit buffer is parallel to serial converter that receives a
parallel byte for conversion into a serial signal and further transmission on the
communication channel. The receive control unit decides the receiver frequency as
controlled by the RXC input frequency. This unit generates receiver ready (RXRDY)
signal that may be used by the CPU for handshaking and also detects a break in the
data string while 8251 is in asynchronous Mode. In synchronous mode the 8251
detects SYNC character using SYNDET/BD pin. 2. 4. 4 OPERATING MODES OF 8251AThe 8251A
can be programmed to operate in its various modes using its mode control words. A
set of control words is written into the internal registers of 8251A to make it
operate in desired mode. Once the 8251 is programmed as required, the TXRDY output
is raised high to signal the CPU that 8251A is ready to receive a data byte from it
that is to be further converted to serial format and transmitted. This
automatically goes low when CPU writes a data byte into 8251A. In receiver mode the
8251A receives a serial data byte from the modem or I/O device. After receiving the
entire data byte, the RXRDY signal raised high to inform the CPU that the 8251A has
a character ready for it. The RXRDY signal is automatically reset after the CPU
reads the received byte from8251A. The signal is received from the modem/receiving
input/output device. The control words of 8251A are of two functional types. mode
instruction control wordcommand instruction control word1. Mode instruction
control wordThis defines the general operational characteristics of 8251A. After
internal (reset command) or external (reset input pin) reset, this must be written
to configure the 8251 as per the required operation. Once this has been written
into 8251A, SYNC character or command instructions may be programmed further as per
requirements.
D7
D6
D5
D4
D3
D2
D1
D0
#S2###S1###EP##PEN##L2#L1##B2##B1## Invalid1 bit1 bit2 bit#0011#0101##0011#010
1#Synch. mode1*Asynch16 *asynch6 4*asynch##
Baud rate select 00110#0101#5 bit6
bit7 bit8 bit##stopbit selectionCharacter length selection#
1-parity enable
0-disable
1-even party
0-odd partyFig. 2. 4 mode inst. Format of
asynchronous mode2. Command instruction control wordThe command instruction
controls the actual operation of the selected format like enable transmit/receive,
error reset and modem control.
D7
D6
D5
D4
D3
D2
D1
D0#EN##IR##RTS##ER##SBRX##RXE##DTR##TXEN###If=1, HUNTFor SYNC
char##1-transmit enable0-disable## Data terminal ready if=1##Internal resethigh
#Forces 8251ATo mode inst. format##Receive enable1-enable0-disable##Send break
char. 1-TXD forced 00-normal op. ###Request to send#If=1 forces RTS=0###
Reset
error flags if=1####Fig. 2. 5 (pp. 286 )STATUS READ DEFINITIONThis definition is used
by the CPU to read the status of the active 8251 to confirm if any error condition
like the requirement of processor service has been defected, during the operation. A
read command is issued by processor with C/D=1 to accomplish this function. Some of
the bits in the definition have the same significance as those of the pins of
8251A. These are used to interface the 8251A in a polled configuration, besides the
interrupt controlled mode. The pin TXRDY is an exception. The status read format
is shown below. D7
D6
D5
D4
D3
D2
D1
D0DSR#SYNDET#FE*#OE*#PE*#TXEMPTY#RXRDY#TXRDY##2. 5 The 8088
microprocessor. The INTEL 8088 is a high performance microprocessor implemented in
N-channel, depletion load, silicon gate technology (HMOS-2),and packaged in a40-pin
CERDIP package. The processor has attributes of both 8- and 16 -bit microprocessors.
It is directly compatible with 8086 software and 8080/8085 hardware and
peripherals. The processor in the design (intel8088) is an 8-bit CPU available in

three clock rates that is 5MHZ, 8MHZ, 10MHZ packaged in a 40 pins CERDIP or plastic
package. 8088 operate in a single processor or multi-processor to achieve a high
performance. #Fig2. 6 pin diagram pf 8088##TABLE1. The pin configuration is shown in
fig2. 6 . Some of the pins serve a particular function in a minimum mode (or single
processor mode) and others function in maximum mode (multiprocessor mode)
configuration. 2. 5. 1 Architecture of 8088The complete architecture of 8088 can be
divided into two parts (a) bus interface unit (BIU) and (b) execution unit (EU).
The bus interface unit contains the circuit for physical address calculation and a
predecoding instruction byte queue (4 bytes long). The bus interface unit makes the
systems bus signals available for external interfacing of the devices. #
Fig. 2. 7functional block diagram#Fig. 2. 8 waveforms of minimum mode#FIG2. 9. waveforms
of maximum mode2. 6 Interrupt and interrupt service routinesWhenever the numbers of
devices interrupt a CPU at time and if the processor is able to handle them
properly it is said to have multiple interrupt processing capability. In case of
8088 there are two interrupt pins, viz. NMI and INTR. The NMI is a non mask able
interrupt input pin. This means that any interrupt request at NMI input cannot be
masked or disabled at any means. The INTR interrupt, however, may be masked using
interrupt flag (IF). Interrupt service routines (ISRs) are the programs to be
executed by interrupting the main program execution of the CPU, after an interrupt
request appears. After the execution of ISR, the main program continues its
execution further from the point at which it was interrupted. 2. 6 . 1 Programmable
interrupt controller 8259AWhile the CPU is executing a program ,an interrupt
breaks the normal sequence of execution of instructions ,diverts its execution to
some other program called interrupt service routines(ISR) . after executing ISR ,
the control is transferred back again to the main program which was being executed
at the time of interruption . A programmable interrupt controller 8259A is able to
handle a number of interrupt at a time. This controller takes care of a number of
simultaneously appearing interrupt requests along with their type and priority.
This relives the processor from all these tasks2. 6 . 2 Architecture and signal
description of 8259AThe architectural block diagram of 8259A is shown in figure
below. The functional explanation of each block is given in the following
text. Interrupt request registers (IRR): the interrupt at IR0 inpute line are
handled by interrupt request registers internally. IRR stors all the interrupt
requests in it in order to serve them one by one on the priority basis. . Fig. 2. 10
The architecture and signal description of 8259A#In-service register (ISR): this
stores all the interrupt those are being served i. e. ISR keeps a track of the
requests being served. Priority resolver: this unit determines the priorities of
interrupt requests appearing simultaneously. The highest priority is selected and
stored into corresponding bit of ISR during INTA pulse. Broadly, there are two types
of interrupts . The first is external interrupt and the second is internal. In
external interrupt, the interrupt, the interrupt is generated outside the
processor. In inter al interrupt is generated internally by execution of an
interrupt instruction . In this project there are two external interrupts. 8088
processor has two interrupt pins, viz NMI and INTR . The NMI is a non-mask able
interrupt input pin which means that any interrupt request at NMI input cannot be
masked or disabled by any means . The INTR interrupt may be masked using the
interrupt flag (IF) . when an interrupt occur by an external device, the cpu
acknowledges the requesting device on its INTA pin immediately of it is an INT
request, the CPU checks the IF flag. If the IF is set, the interrupt request is
acknowledged using the INTA pin. If the IF is not set the interrupt requests are
ignored. In this project the interrupts are mask able interrupts. The INTR types may
be from 00 to FFH if more than one types of INTR interrupts occurs at a time then
an external chip called programmable controller is required to handle them. In this
project programmable interrupt controller 8259A is used to handle the interrupts
occur by programmable interval timer 8253 and programmable communication interface
8251A USART. #Fig2. 11. the pin out of 8259A2. 7 Programmable interval timer 8253Intel
programmable counter / timer device 8253 facilitates the generation of accurate
time delays. When 8253 is used as a timing and delay generation peripheral, the
microprocessor becomes free from the task related to the counting process and can

execute the program in memory, while the timer device may perform the counting
tasks. This minimizes the software overhead on the microprocessor. 2. 7. 1
ARCHITECTURE AND SIGNAL DESCRIPTIONThe programmable timer device 8253 contains
three independent 16 -bit counters. It is possible to generate three independent
counters simultaneously. All the three counters may be independently controlled by
the three internal command word registers. The 8-bit bidirectional data buffer
interface internal circuit of 8253 to microprocessor system bus. Data is
transmitted or received by the buffer upon the execution of IN and OUT
instructions. The internal block diagram and pin diagram of 8253 are shown below. #
Fig. 2. 12
Architecture and signal description of 8253. The
8253 can operate in six different modes. The following are the six different
modes. Mode 0 ( interrupt on terminal count )Mode 1( programmable mono shot )Mode 2(
rate generator )Mode 3 ( square wave generator )Mode 4 ( software triggered
strobe )Mode 5 ( hardware triggered strobe )In this project mode 0 operating mode
of 8253 is used. Mode 0 operations are generally called as interrupt on terminal
count. In this mode, the output is initially low after the mode is set. The output
remains low even after the count value is loaded in the counter. The counter starts
decrementing the count value after the falling edge the clock, if the GATE input is
high. The process of decrementing the counter continues at each falling edge of the
clock till the terminal is reached, i. e the count becomes zero. When the terminal
count is reached , the output goes high and remain high till the selected contain
word register or the corresponding count register is reloaded with a new mode of
operation or a new count, respectively. This high output may be used to interrupt
the processor whenever required, by setting a suitable terminal count. A0, A1 pins
are the address input pins and are required internally for addressing the mode
control word registers and the three counter registers. A low on CS line enables
the 8253. The following table shows the selected operation for various control
inputs. CS#RD#WR#A1#A0#SELECTED OPERATION##0#1#0#0#0#Write counter
0##0#1#0#0#1#Write counter 1##0#1#0#1#0#Write counter 2##0#1#0#1#1#Write control
word##0#0#1#0#0#Read counter 0##0#0#1#0#1#Read counter 1##0#0#1#1#1#Read counter 2
##0#0#1#1#1#No operation(tri stated )##0#1#1#x#x#No operation(tri stated )
##1#X#x#x#x#Disabled(tri stated)##TABLE-22. 7. 3 CONTROL WORD REGISTERA control word
register accepts the 8-bit control word register by the microprocessor and store it
for controlling the complete operation of the specific counter. A control word must
be written in the respective control word register by the microprocessor to
initialize each of the counters of 8253 to decide its operating mode. D7
D6
D5
D4
D3
D2
D1
D0Sc1#Sc0#RL1#RL0#M2#M1#M0#BCD##SC1#SC0#OPERATION##0#0#SELECT COUNTER 0##0#1#SELECT
COUNTER 1##1#0#SELECT COUNTER 2##1#1#ILLEGAL##SC-select control bit definitions
RL1#RL0#OPERATION##0#0#Latch counter for on the fly reading##0#1#Read /load least
significant byte only##1#0#Read /load MSB only##1#1#Read /load LSB first then
MSB##RL-read or load bit definitionBCD#OPERATION##0#HEXADECIMAL COUNT##1#BCD COUNT
##M2#M1#M0#SELECTED MODE##0#0#0#Mode 0##0#0#1#Mode 1##X#1#0#Mode 2##X#1#1#Mode
3##1#0#0#Mode 4##1#0#1#Mode 5##M2M1M0-Mode select bit definitionFig. control word
formats and bit definitionsIn this project the control word format selected is as
followD7
D6
D5
D4
D3
D2
D1
D0
0#1#1#1#0#0#0#0##=30H2. 8 PIO 8255A [programmable i/o port] One of the most
important programmable chips for our design that is already hardwired in the MTS-88
kit is the 8255 programmable I/O port. The Intel 8255A pio is designed for use with
Intel 8-bit, 16 -bit & higher capability microprocessors. It has got 24 lines that
can be programmed in to two groups of 12 lines or three groups of 8 lines. The two
groups of i/o pins are named as group A & group B. group A contains an 8-bit port
A(pa0-pa7) along with a 4_bit port C(pc4-pc7) upper . similarly group B contains an
8-bit port B (pb0-pb7) & a 4-bit port C lower bits(pc0-pc3). the port c lower &
upper bits can together be used as an 8-bit port c( i. e. to make up three 8-bit
ports)& both of them have the same adders. All of this ports, i. e. 3 d/f 8-bit
ports or two 12-bit ports can function independently ass i/o &this can be achieved
by programming the bits in an internal register of 8255a called control word
register(CWR). #Fig2. 13.
Internal architecture of 8255A PIOFig above shows the

internal architecture of 8255A. the 8-bit,3 state bidirectional buffer is used to

interface the 8255A internal data bus with the systems bus& its controlled by the
read/write control logic ,which manages all the internal & external transfer of &
control words with the input pins from the microprocessor (RD,WR,A1,A2)It defines
the adders for the d/f ports & CWR data read or write & the data buss buffer
receives or transmits data upon the execution of i/o instruction by the
microprocessor to 8255A. 2. 8. 1 Pin description of 8255A#Fig. 2. 14
Pin
configuration of 8255AA01-A02: These lines are the address input lines driven by
the microprocessor. This address lines are used to select one of the four internal
registers (i. e. 3 ports & CWR). This address lines together with RD, WR&CS forms the
following operation for 8255A. #TABLE-3 Basic operation of 8255AActually in our case
all the address have already been decided, since the 8255A is already hardwired
inside MTS-88, here the A1&A0 of 8255A are wired to A2&A1 of 8088 microprocessor
respectively & the address for all four registers will be as follows. 10H=#0
0
0
1
0
0
0
0#Port A##12H=#0
0
0
1
0
0
1
0#Port B##14H=#0
0
0
1
0
1
0
0#Port C##16 H=#0
0
0
1
0
1
1
0#CWR##Hex. AddressFig. 2. 15
Port address
for the four registers of 8255A (here the A0 address line is dont care)2. 8. 2Mode
of operation:There are two basic modes of operations of 8255A; these are the I/O
mode & the bit set reset (BSR) mode. In the I/O mode all the 8255 ports work as
programmable I/O ports. But in BSR mode only port C (pc0-pc7) can be used to set or
rest its individual port bits. So based on the lack of control of all ports we
chose to use the I/O mode of operation in our project. Under the I/O mode of
operation further there are three modes of operation, this are mode 0, mode1&mode2.
But for our specific design of interfacing LED matrix as o/p device we found it
suitable to use mode 0 of operation. Mode 0(basic I/O mode): this mode provides a
simple I/O capability of using each of the three ports. Data can be simply read
from & written to the input & output ports respectively, after appropriate
initialization. In this mode two 8-bit ports (port A & port C) & two 4-bit ports
(port C upper & lower) are available. The two 4-bit ports can be combinedly used as
a third 8-bit port i. e. a maximum of four ports is available. Also any port can be
used as input or output while the o/p is latched & the input is not. The
programmable internal registers (CWR) have two formats: i. e. 1st valid for I/O mode
& the other for BSR mode, but since we used only mode0 of I/O mode we only focus on
that. #Fig2. 16 .
Mode 0 CWR formatHere as it can be seen from the picture above,
the bit D6 & D5 selects the mode of operation for port A, port B mode can be either
0 or 1 depending on D2 bit . D7 decides whether its an I/O mode or BSR mode. Any
one of the three ports can be programmed as o/p or i/p port by simply using 0 for
o/p and 1 for i/p port in the respective bit of the d/f ports in the CWR format. In
our case the CWR format will be as follows:D7
D6
D5
D4
D3
D2
D1
D01#0#0#0#0#0#0#0##=80H
Fig2. 16 . CWR of 8255A implemented on the design74LS138; 3:8 LINE DECODERSPin
name#description##A,B,C#Address inputs########E1-E2 (G2A,G2B)#Enable inputs(active
low)##E3(G1)#Enable input(active high)####O0-O7#Outputs (active low)##In place of
8255 we prefer to use latch and decoder combination for input/output peripherals
interfacing for it enables us to have a number of columns as we require. The IC we
are going to use for the purpose of decoding is 74LS138. it is the most widely used
3:8 line decoder in microprocessor or microcontroller based system. It is also high
speed 1 of 8 decoder or de multiplexer. Table474138 chips is 16 pin chips with A, B,
C select lines to select require#d output line to be active. G2A and G2B, two
inputs are active low enable inputs G1 is active HIGH enable input. Finally O0-O7
are, 8 active low outputs, present to understand the working of the functional
diagram.
inputs#outputs##G2A#G2B#G1#A#B#C#O0#O1#O2#O3#O4#O5#O6 #O7##H#X#X#X#X#X#H#H#H#H#H#H#H
#H##X#H#X#X#X#X#H#H#H#H#H#H#H#H##X#X#L#X#X#X#H#H#H#H#H#H#H#H##L#L#H#L#L#L#L#H#H#H#H
#H#H#H##L#L#H#H#L#L#H#L#H#H#H#H#H#H##L#L#H#L#H#L#H#H#L#H#H#H#H#H##L#L#H#H#H#L#H#H#H
#L#H#H#H#H##L#L#H#L#L#H#H#H#H#H#L#H#H#H##L#L#H#H#L#H#H#H#H#H#H#L#H#H##L#L#H#L#H#H#H
#H#H#H#H#H#L#H##L#L#H#H#H#H#H#H#H#H#H#H#H#L##TABLE-5 truth table of 74LS138LATCH
(74LS373)The transmitted data to the display board, in our case LED matrix display,

is to be latched before being displayed. The IC we have selected for this purpose
is 74373 which is the most widely one. The 74373 is an 8 bit latch. It contains 8 D
type flip flop. The Q output of this flip flop is connected to inverting buffer
7404. The latch is controlled by CLK pin and buffer is controlled by OC pin. When
CLK=1, the D type latch will transfer data from input to output. But when negative
transition or falling edge of CLK appears, the contents will get latched into D
flip flop. When OC=0, the output of D flip flop is made available on output pins.
But when OC=1, output lines are tri-stated. The IC we have used in between 74373 and
74138 is called INVERTER BUFFER. this inverting is made by IC called 7404.
PART
THREE
SOFTWARE
Software1. INTRODUCTION1. 1 Assembly
and higher level languages. When ENIAC (Electronic Numerical Integrator and
Computer), the first digital computer, was under construction, Dr. John Von Newman
of the moore school of electrical engineering, wrote
a paper in collaboration with A. W Burks and H. H. Goldstein that would define the
architecture to be used by nearly all computers from that day on. Von Newman
suggested that, rather than rewrite the computer for each new task, the program
instructions should be stored in a memory unit just like the data. The resulting
computer would then be software programmable rather than hardware programmable. Von
Newmanns proposal is now called the stored-program concept. Fundamentally all
computers are programmed in binary. However, this can be very awkward for human
beings. A microprocessor would understand only a code written in binary (1 and 0)
representing two distinct logic levels. This type of program is referred to as
object code and is the only code a computer can executes. However, it is nearly
impossible for a human being to work with. Programs encoded in hexadecimal figures
like
- DB , 00, 47 , DB , 00 , 76 - is somehow more readable to human
beings even if the function of the program is still not clear. These codes like the
object codes are processor specific and have human readable corresponding
representations commonly known as mnemonics. Programming the computer only in
hexadecimal operation codes is referred to as machine language programming. Some
computers allow the mnemonics to be entered directly, which then is called assembly
language programming. The intent of all higher-level languages is to let the
programmer communicate in a language as similar as possible to his or her own.
Programming in these languages requires an interpreter or a compiler. The use of an
interpreter may result in very slow program execution. Worse, if the computer is in
a loop, the interpreter will continue to interpret the instructions in the loop
over and over. A compiler is used to convert a high-level language program to object
code. Using a compiler is similar to using an assembler, because an editor must be
used for creating the application program file. When the compiler is called on, it
compiles the high-level language program into a file containing binary machine
code. This has several advantages over the interpreter. For one, the code does not
have to be reinterpreted over and over when loops are encountered. In addition, the
resulting object code file will run all by itself without the need for the compiler
to be resident in memory, allowing saving of memory space and running of large
programs. LANGUAGE SELECTIONThe two programming languages that were made use of in
the implementation of this project were the intel-8088 microprocessor assembly
language for programming the device microcontroller module, and the Microsoft
Visual Basic v. 6 higher level language to design the graphic user interface (GUI)
and the application software having the serial port driver routines embedded
inside. There were several criteria in the selection of these languages for the
project. A.
The intel-8088 assembler low level languageDirect hardware programming
languages, like some of the old programs for the microcomputers, are processor
specific. These languages are referred from a list of all the valid instructions
for the particular processor known as instruction sets. Hence the choice of
assembly languages is completely dependent on the kind of processor selected. Of
course the choice of the processor itself is made up taking in consideration the
availability of its assembler and other support tools. Hence the project designer
believes that referring to the criteria used in the selection of the intel-8088
microprocessor is enough to validate the selection of the assembler. In addition
the Barleywood intel-8088 assembler and virtual machine simulator used were

equipped with all the necessary tools and compatibility with other necessary tools
like the EPROM programmer device & software. B.
The Microsoft Visual Basic v. 6 GUI
design platformAs was mentioned the other programming language used was the visual
design platform, Visual Basic v. 6 , from the Microsoft visual studio family. This
platform was explicitly used in the design of the LED matrix display programmer
software providing the user interface, the application tools like the preview
simulator and the port access and driver modules. Since the running medium for this
software is the PC there was more freedom in selecting the best fitting platform
among a choice of many. Some of the most crucial ones are discussed briefly. Being
equipped with the necessary functions and controls. Like the rest of the Microsoft
visual studio members, Microsoft visual Basic is supported by the compiled multiplatform (language) components database and help library (MSDN). The visually
accessible controls and design tools exist in a wide range of usability and
flexible behavior. One especially important control is the serial communications
control (MSCOMM). Like the rest of the controls it can easily be dragged and added
to the design and the port access and communication actions can be as easily be
controlled by setting the various behaviors for the control. Other platforms also
support similar ready-made communication functions. But most support them in a way
that is too complicated to use or too rigid to control. For instance using the
Borland C++ compiler would mean that one has to check several port committed
registers first in order to try and access it. Also port access error messages are
not readily interpretable as are in Visual Basic. Worse still in other programming
languages the whole port access routine has to be written from scratch. Ease of use.
One very unique feature of the Visual Basic programming language is that it is very
easy to use. It has the capabilities of developing most of the routine intrinsic
codes needed to run the application under design while letting you worry only about
the features directly related with the problem at hand. This is, according to the
Microsoft Visual Studio documentation, done by standardizing most of the usually
needed functions in predefined modules and controls so that the most the user can
change is a set of properties for the control. This way a designer can use precoded functions while at the same time maintaining compatibility with other
applications, and resources. 2.
THE INTEL-8088 MICROPROCESSOR ASSEMBLY PROGRAM2. 1
TECHNICAL BACKGROUND. 2. 1. 1.
The instruction set and the mnemonic formats.
Addressing modes. The instruction set of a microprocessor lists the various
instructions available to the processor to operate on data. if one compares two
instructions it can be seen that the operation can be the same for both
instructions, however the operands are different. Microprocessors typically have
different ways of specifying the source and destination operands. These various
ways are known as addressing modes. Thus addressing modes describe the type of
the
operands and the wayThey are accessed for executing an instruction. 8088 supports 12
types of addressing modes operation as described below. MOV AX,0005H
Immediate
i. e. in this type of addressing immediate datais part of instruction. MOV AX,[0005H]
directMOV BX,AX
registerMOV AX,[BX]
Register indirectMOV AX,[SI]
IndexedMOV AX,6 0H[BX]
Register relativeMOV AX, [BX] [SI]
Based
indexedMOVAX, 6 0H [BX] [SI]
Relative based indexedJMP SHORT LABEL
Intra segment directJMP [BX]
Intra segment indirectJMP 0005H
Inter-segment directINSTRUCTION SETS OF 8088THE 8088 instructions are classified
into the following main typesI. data copy/transfer function- -are used to transfer
data from source operand to destination operand. II. ARITHIMETIC AND LOGICAL
INSTRUCTION-all the instructions performing arithmetic, logical, increment,
decrement, compare, and scan instructions belong to this category. III. branch
instructionsthese instructions transfer control of execution to the specified
address. All CALL, JUMP, interrupt and return instruction are part of thisIV. LOOP
INSTRUCTIONS-if these instructions have REP prefix with CX used as count register,
they can be used to implement unconditional and conditional loops. LOOP, LOOPZ and
LOOPNZ are loop instructions. V. MACHINE CONTROL INSTRUCTIONS-control the machine
status . NOP, HLT, WAIT and LOGK instructions are machine control instructions.
VI. FLAG MANIPULATION INSTRUCTIONS-instructions like CLD, STD, CLI, and STI which
directly affect the flag register are classified under this group. VII. SHIFT AND

ROTATE INSTRUCTIONS- Involve bitwise shifting or rotation in either direction with

or without a count in CX. VIII. STRING INSTRUTIONS-involve various string
manipulating operations like load, move, scan, compare, store etc. PROGRAM FLOWCHART
#################################CALL PIC INITIALIZATION ROUTINE##ENABLE CPU
INTERRUPTS####MAIN SYSTEM PROGRAM #The main system code is that boots up the
microcontroller with some CPU initialization instructions and calls to other
subroutines as per program or interrupt request. The steps are listed as follows:
1. 1 RESET THE DISOLAY DATA STORAGE MEMORY AREA1. 1. 1 Load the first byte of the
display data area withthe default scroll speed setting. 1. 1. 2 Load the BX register
with the number of display columns. 1. 1. 3 Load the SI register with initial memory
pointer value. 1. 1. 4 Load the accumulator register A 01. 1. 5 Load the memory address
pointed by the HL pair with theValue in the accumulator(0). Increments the SI
register value. Decrements the B register value. 1. 1. 8Check the status of the value
in the B register. If not zero then execute the steps from 1. 15 on again. If zero
then return to calling routine. CALL THE USART INITIALIZATION ROUTINE. CALL THE PIT
INITIALIZATION ROUTINE. CALL THE PICINITIALIZATION ROUTINE. LOAD
THE BX REGISTER WITH THE ADDRESSENABLE THE CPU INTERRUPT ACKNOWLEDGE. 2. START
DISPLAYING THE DISPLAY DATA IN MEMORY. (This routine will display the data stored in
memory on the display output ports by continuously incrementing the memory pointer
(reg. SI ) value as well as the output port pointer (reg. CX) so that each column
(output port) will get its own data. this process will repeat over and over again
and the fast scan rate will give the illusion of all the columns being lit at
the same time. )Load the DX register pair with the values in the SI registerTest the
DX register for the value 126 a.
If zero load the SI register and the DX
registers withthe address of the display data area in memory. b . If not zero
continueLoad the BX register with the number of columnson the display panel. Load
the CX register with the address of the first displayoutput port (first column).
Load the accumulator with the value in memorylocation pointed by the DX register.
Out put data of accumulator trough the display port address(address specified in CX
register)2. 7
Increments the CX register value. 2. 8
Decrements the BX register
value. If it did not reach zero repeat steps from 2. 6 onwards. Executing the steps
from 2. 1. B. DEVICE INITIALIZATION ROUTINES. The device initialization routines are
the codes responsible for the setting of the interrupt-mapped devices in a proper
way so that the CPU can maintain a proper interaction with them either in input
output or internal operations. In our system there are three I/O devices in the
system (USART ,PIT,& PIC) are programmable and thus need initialization routines to
set their various control registers. The algorithms followed in coding the
routines are as follows:1. USART INITIALIZATION ALGORITHMLoad a memory location
with the address of theUSART interrupt acknowledge ISR. 1. 2 Load the A register
with mode word to determine generalcharacteristics of USART. 1. 3 Load the A
register with the channel control word thatDetermine the mode of operation for
USART. 2. PIT INITIALIZATION ALGORITHMDisable interrupt modes of the CPU. Load the A
register with the channel control word that would determine the mode of operation
for the PIT (timer),Load the time constant the value in memory location reserved
for scroll speed setting. HLoad a memory location with the address of the DART
interrupt acknowledge ISR. Return to the calling routine. 3. PIC INITIALIZATION
ALGORISM3. 1
Load initialization command word (ICW1). It contains the control bits
for edge/level triggeredmode, single /cascade mode, call address interval and
whether ICW4 is required or not,etc. 3. 2
Load initialization command word (ICW2)
(stores details regarding interrupt vector address)3. 3
Load operation command
word (OCW1)3. 4
Load operation command word (OCW2)C. INTERRUPT SERVICE ROUTINES
(ISR). These subprograms are responsible for responding appropriately to the
particular interrupt request. The algorithms for the ISRs of both devices are
described below. 1. DART ISR ALGORITHM. Load the B register with the number of data
to be received. Load the DE pair with the address of the received data storage
memory area. Check whether the USART contains a character or nota. If available
disable interrupts of the device, loadthe character from the USART data port, store
itin the memory location pointed by the CXregisster increment CX, Enable interrupts
ofthe device, decrement the BX register value andif not zero repeat step 1. 3. . If

zero jump to step1. 4. If not available repeat steps from 1. 3. . Call the USART
initialization routine to reprogram thedevice in order to prepare it for another
reception. 1. 5 Call the PIT initialization routine to reprogram the devicein order
to let it assume the new PC sent time constantvalue corresponding to the scroll
speed. 1. 6 Reload the display port address and column counter valuesin the BX and CX
registers, as well as the memorylocation pointers (DX & SI)1. 7 Enable the CPU
interrupts. 1. 8 Return from interrupt call. 2. CTC ISR ALGORITHM1.
Increment the
display data current memory location pointer(the SI pair) value. 2.
Enable the CPU
interrupts. 3.
Return interrupts call. #make COM#; COM file is loaded at CS:0100h
ORG 100hUSARTC
EQU 57H
;USART CODE PORT ADRESSUSARTD
EQU 56 H
;USART DATA PORT ADRESSCOUNT1
EQU 02H
;8253 COUNTER1 PORT ADRESSPITCWR
EQU 06 H
;8253 CWR PORT ADRESSRPIOPA
EQU 10H
;8255 PORTA
ADRESSCPIOPB
EQU 12H
;8255 PORTB ADRESSPIOCWR
EQU 16 H
;
8255 CWR PORT ADRESSCOL
EQU 141H
; NUMBER OF DISPLAY DATA BYTES
DIP
EQU 0203H
;DISPLAY PORT START ADDRESS
;***************************************************************;
MAIN SYSTEM
CODE;***************************************************************MAIN: CLI
;CLEAR CPU INTERRUPTSCALL RESET_MEMORY
;RESET DISPLAY MEMORYCALL
START_USART
;INITIALIZE THE USARTCALL START_PIT
;INITIALIZE THE PITCALL START_PIC
;INITIALIZE THE PICMOV
BX,0700
;SET THE DISPLAY MEMORY AREA; INITIAL ADDRESSSTI
;SET CPU INTERRUPTCALL SHOW
;CALL THE DISPLAY ROUTINE
;***************************************************************;
RESET
DISPLAY MEMORY;**************************************************************
RESET_MEMORY :MOV AX,0000H
;LOAD ACCUMULATOR WITH; ADDRESSMOV DS,AX
;TO DEFINE THE SEGMENT ADDRESSMOV AX,150
;SCROLL SPEED DEFOULT VALUE
MOV BX,COLMOV SI,AXMOV AL,00
;VALUE TO RESET MEMORYWITHMOV
SI,0701H
;INITIAL MEMORY POINTER VALUERESET:
MOV [SI] ,AL
;RESET MEMORYINC SI
;MOVE TO THE NEXT LOCATIONDEC BX
;DECREMENT COUNTERJNZ RESET
; IFNOT ZERO ELSERET
;BACK TO THE CALLING ROUTINE
;****************************************************************;
DEVICE
INITIALIZATION;****************************************************************
START_USART: MOV AL,5EH
; LOAD MODE WORD TO ACCUMULATOROUT 5EH,AL
;WRITE TO CONTROL PORTMOV AL,14H
;LOAD COMMAND WORD TO; ACCUMULATOROUT
5EH,AL
; WRITE TO CONTROL PORTMOV AX,OFFSET USART_ACKMOV [ 0040] ,AXMOV
AX,0000HMOV [0042H] ,AXSTART_PIT: CLIMOV AL,70HOUT PITCWR,ALMOV CX,0700MOV AX,CXOUT
COUNT1,AL; OUT COUNT1,AHMOV AX,OFFSET PIT_ACKMOV [0040H] ,AXMOV AX,0000HMOV
[0046 ] ,AXRETSTART_PIC:MOV AL,1FHMOV DX,0030HOUT DX,ALMOV DX,0032HMOV AL,10HOUT
DX,ALMOV AL,03OUT DX,ALMOV AL,0C2HOUT DX,ALMOV DX,0030MOV AL,6 8HOUT DX,ALRET
PIT_ACK: INC BXMOV CX,0700MOV AX,CXOUT COUNT1,AL;OUT COUNT1,AHSTIIRETUSART_ ACK:
MOV BX,COLMOV CX,0700HCALL MONITORCALL START_USARTCALL START_PITMOV DX,DIPCALL
RESTARTSTIIRETMONITOR:MOV AL,15HOUT 57H,ALREADY:IN AL,57H; AND 02; JZ READY; CALL
DISABLECALL STORE;CALL ENABLEDEC BXRETJMP MONITORRESTART: MOV SI,0701HMOV CX,0701H
RETSTORE:IN AL,56 HMOV CX,AXINC CXRETSHOW:MOV DX,SIRCL DL,01; CALL NC RESTARTMOV
BX,12MOV CX,DIPSH: MOV AX,[DX] OUT (CX),AXINC DXINC CXDEC BXJNZ SHJZ SHOWUSER
INTERFACE SOFTWARE IN VISUAL BASIC v 6 . 1. This is the software at the PC side of the
project. Its main task is to provide a graphic user interface, enabling interaction
with the user, receive the text the user enters in a text box (with the necessary
font adjustments), convert the text to bitmap format of device matched resolution,
perform all the necessary binary to decimal and numeric to ASCII conversion of the
bitmapped text initialize the serial communications port of the host computer and
send the bitmapped and properly converted display data along with other variables
such as scroll speed value through the port. TECHNICAL BACKGROUNDTEXT TO PIXEL
CONVERSION FUNCTIONThis specialized subroutine is responsible for converting the
windows based true type font graphic figures to a custom resolution bitmap
matrix. The subroutine scans the text box (a container control) at a predefined
interval downwards each row. The scan function detects a black pixel color to

register it in a bitmap holding double array as ON, else it would be registered

OFF. In this way all elements of the text box matrix are scanned (in a way
bitmapped). The resolution of the scan is readily adjustable but is hardware
dependent, as the bitmapped fonts are directly transferred to the display hardware
and mapped to the LED board of the same matrix size. BINARY TO DECIMAL CONVERTER. As
discussed earlier the hardware I/O ports are so mapped that each column in the
display matrix is considered one port. Hence the data characters from the interface
should come as data for a port. Also the interface port transfers files through the
serial port in forms for characters (numeric). This necessitates the use of a
binary to decimal converter routine in order to convert the data of each column to
decimal. The matrix type arrangement helps in this part since the bitmap conversion
of each column puts it readily in binary format. NUMERIC TO ASCII CONVERSIONThe
popular IBM compatible PC communicates to the outside world in the language of
ASCII. These are a set of predefined numeric values for the common alphanumeric and
editing characters (both upper and lower cases). The extended ASCII set supports
256 characters by 8 bit binary values. Thus in order to transfer any numeric value
through the port it first has to be converted to
the corresponding ASCII character. Visual Basic has a ready made function to
produce theses characters from a given integer value given it lies between 0 &
255 (inclusive). The syntax is: -[ASCII character] = chr(
[integer value] )
SERIAL PORT ACCESS & CHARACTER TRANSFER. For such a purpose, just like any of the
others, VB supports a serial communication control named MSComm (Microsoft
communication control). This control is easily dragged and added to the active form
previous to using it. It represents directly the serial port and so by setting or
monitoring its properties one can do the same to the actual port. FLOWCHARTS OF KEY
SUBROUTINESTEXT TO BITMAP CONVERSION# SHAPE \* MERGEFORMAT ####BINARY COLUMN DATA
TO DECIMAL CONVERSION# SHAPE \* MERGEFORMAT ####PROGRAM CODE. The program code for
some of the key subroutines discussed in previous sections is listed below. CODE FOR
CONVERTING TEXT BOX FONTS TO BITMAP FIGURESPrivate Sub cmdCONVERT_TEXT_Click()Dim
Count, i, j, K, l, m, X, Y As IntegerK = 100With Pic3. Font. Size =
rt. SelFontSize. Name = rt. SelFontName. Bold = rt. SelBold. Italic = rt. SelItalicEnd
WithPic3. Print rt. TextCount = 0X = Pic3. Width / NUMCOLY = Pic3. Height / 32For j = 1
To 32 Step 1For i = 1 To NUMCOL Step 1Pic2. PSet (i * X, j * Y), Pic3. Point (i * X,
j * Y)If Pic3. Point(i * X, j * Y) = vbBlack ThenCount = jm = 2Exit ForEnd IfNext i
If m = 2 ThenExit ForEnd IfNext jX = Pic2. Width / NUMCOLY = Pic2. Height / 16 For j =
1 To 16 Step 1'lblFontSize. Caption = CountFor i = 1 To NUMCOL Step 1Pic2. PSet (i *
X, j * Y), Pic3. Point(i * X, Count * Pic3. Height / 32)If Pic3. Point(i * X, Count *
Pic3. Height / 32) = vbBlack ThenLedFlag(j, i) = 1ElseLedFlag(j, i) = 0End IfNext i
Count = Count + 1Next jX = Pic. Width / NUMCOLY = Pic. Height / 16 l = m = 0For i = 1
To 16 Step 1l = 0For j = 1 To NUMCOL Step 1If LedFlag(i, j) <> 0 ThenPic. Line (l,
m)-(l + X, m + Y), &HFFFF&, BFElsePic. Line (l, m)-(l + X, m + Y), &H6 00F&, BF
Pic. Line (0, l)-(Pic. Width, l), vbBlackEnd Ifl = l + XNext jm = m + YIf m = 16 Then
m = 0End IfNext iFor i = 1 To 16 Step 1Pic. Line (0, (i * Y))-(Pic. Width, (i * Y)),
vbBlackNext iFor i = 1 To NUMCOL Step 1Pic. Line ((i * X), 0)-((i * X), Pic. Height),
vbBlueNext irt. SetFocusEnd SubPrivate Sub rt_Change()If Check1. Value = 1 Then
cmdOK_ClickEnd IfEnd SubCODE FOR BITMAP COLUMN BINARY DATA TO DECIMAL CONVERSION
Private Sub CONVERT_TO_DECIMAL_Click()For i = 1 To 129 Step 1CONUM (i) = 0Next i
CONUM(1) = 255 - Text3. TextFor i = 2 To 129For j = 0 To 15 Step 1If Led Flag(j + 1,
i) = 1 ThenCONUM(i) = CONUM(i) + 2 ^ jIf CONUM (i) > 255 ThenCONUM(i) = CONUM(i) 2 ^ jEnd IfEnd IfNext jNext iEnd SubTHE USER INTERFACEThe diagram below shows what
the user interface looks like on the host computer screen. The various buttons and
input / output objects on the graphic user interface are explained with sufficient
depth in the user manual of the device. Even though most of the features shown on
the diagram are not visible on the GUI of the final software, for the purpose of
more illustrative approach they are included here. For instance the port access and
monitor buttons and the bitmap binary to decimal conversion button are not required
since the functions they initiate are a necessity by default and should be taken
care of automatically. Note that once the control is passed through operating
variables to the computer via the interface, the whole control becomes easily

upgradeable. Hence apart from the features found sufficient for the completion of
this project many additional features including image mapping and other types of
animations like blink (only scroll was implemented for the project) could be added.
# EMBED PBrush ###LIMITATIONSAlthough the overall progress up to the final
achievements of the implementations of this project, as the designer believes, has
been a success there have been numerous obstacles and limiting factors either
material or non material along the way. Even if these limitations, besides imposing
a limit on the physical interpretation of the design in the planned manner of
presentation, have little or no significance in the issue of achieving the intended
know how that should be gained from the whole work they could (and indeed did)
result in a considerable waste of valuable time as well as effort. Only the most
significant of these limitations are discussed here. I.
Display modules:- The
final output of the implementation was designed to be a display matrix of 16 rows
and at least 3 times number of columns to make up a presentable form of display.
But there had been a shortage of packaged LED matrix modules and building up the
whole array from commercially available individual LEDs required a considerable
amount of finance, which could not be afforded by the designer. Thus it was found
choice less to limit the array to a smaller matrix, which, although sufficient to
demonstrate the intended operation of the device, could not provide a full overview
of the wider application potentials. Also several other hardware components were not
in sufficient numbers or totally missing so that replacing them with similar ones
limited the full functionality of the device. For instance a baud rate clock
generator IC by the specification MC14411 would have, if available, made it
possible to transfer serial data from the interfaced PC to the device at higher
rates. But the use of the 555-timer/clock generator as a replacement limited the
data rate to 6 00 bauds (bits per second) so that there is a detectable time gap
between transmission command and start of display. CONCLUSION AND RECOMMENDATIONThe
principal aim of this project has been the design and implementation of a PC
interfaced and microcontroller based LED matrix display which utilizes a low cost
scheme to support multiple fonts and type sets including the Geez phonetic. In
fact the scheme happened to enable the support of not only fonts but also any kind
of graphic image that could be bitmapped. Hence with just slight modifications to
the software on the PC side a variety of tasks suitable for a wide range of
applications could be included. In light of the above facts one can readily see that
this project involved the design and implementation of conventional digital
hardware, the use of a microcontroller system, serial transmission techniques,
computer interfacing, and higher level language programming up to its completion.
Thus, as the designer believes, the amount of know how one can gain throughout the
project is enormous. Contrasting the points mentioned with what actually was able to
be achieved it can be claimed that, in terms of attaining the aimed principal
goals, the project has been a success. The designer was also able to assess the
depth of his understanding in the subject and his ability to interpret this
theoretical understanding in terms of technical implementation. Some of the
features, either due to the lack of adequate time or resources, could not be
included as planned.
Also, as mentioned in the limitations section, the use
of the MC14411 or equivalent baud rate generator could have enabled high speed
serial data transfer rates without any loss or error on data as the 555 timer tends
to introduce when attempted to operate in higher frequencies. #START DISPLAYING THE
DISPLAY DATA STORED IN MEMORYCALL PIT INITIALIZATION ROUTINECALL USART
INITIALIZATION ROUTINEYESNOIS LOOP COUNTER=0?DECREMENT THE RESET LOOP COUNTER
INCREMENT THE DISPLAY MEMORY POINTERLOAD REG. A WITH
0 AND OUTPUT IT TO THE
POINTED MEMRY LOCATIONLOAD RESET LOOP COUNTER VALUE TO REG. BSTORE DEFOULT SCROLL
SPEED VALUESET THE START ADDRESS OF DISPLAY MEMORY
STARTPoint to column 1Point
to row 1Is pixel color =black?Set element flag = 1Set preview simulator element ON
Move to next rowEnd of rows?Move to next columnEnd of columns?ENDSTARTYESYESYESNONO
NOSTARTPoint to column 1Set column value = 0End of columns?Point to column 1Point
to row 1Is element flag ON?add 2^[row #] to column valueMove to next rowEnd of
rows?Move to next columnEnd of columns?ENDYESNONONONOYESYESYES
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