555 Astable

555 astable
Una aplicacin del temporizador 555 es la de un multivibrador astable o circuito reloj como se muestra en la figura. Para este funcionamiento conectamos la entrada umbral a la entrada de disparo. La frecuencia de salida est determinada por R1, R2 Y C1, mientras C2 solo sirve para en desacoplo y no interviene en el funcionamiento.
Inicialmente, cuando se conecta el condensador C1 esta descargado y por lo tanto la tensin de disparo (pin 2) es de 0v . Esto da lugar a que la salida del comparador B este en nivel alto y la salida del comparador A este en nivel bajo en consecuencia la salida de Q esta a nivel bajo manteniendo el transistor bloqueado. Luego el condensador C1 empieza a cargarse por medio de R1y R2, en el momento que alcance el valor de 1/3 Vcc la salida del comparador B cambia a un nivel bajo y cuando el voltaje de dicho condensador alcanza el valor de 2/3Vcc la salida del comparador A cambia a nivel alto, haciendo que la salida del lacht cambie a un nivel alto, poniedo el transistor en saturacin en consecuencia se inicia la descarga del condensador C1 a travs de R2 y el transistor. Una vez iniciada la descarga del condensador, desendientdo por debajo de 2/3Vcc la salida del comparador A cambiara a un nivel bajo y al llegar a 1/3Vcc la salida del comparador B cambiara a un nivel alto, en consecuencia la salida de Q estar en un nivel bajo manteniendo el transistor bloqueado, repitindose el ciclo nuevamente.

Funcionamiento basico del 555 Funcionamiento como monoestable
Publicado por Miguel Delgado en 21:52 Enviar por correo electrnicoEscribe un blogCompartir con TwitterCompartir con Facebook Etiquetas: 555, astable, multivibrador, temporizador
555 monoestable
Para lograr que el temporizador 555 funcione como monoestable no redisparable, utilizaremos una resistencia y un condensador externo segn muestra la figura, el ancho del pulso de salida se determina mediante la constante del tiempo, la cual se calcula en funcin de R1 y C1 que se indica en la siguiente formula tw=1.1R1xC1 La entrada de tensin de control no se usa y para evitar ruido que pudiera afectar el nivel umbral de disparo se desacopla con un condensador C2.
El tiempo inicial antes del disparo la salida esta a nivel bajo y el transitor Q1 conduce tenindose a C1 descargado. Al aplicar un impulso de disparo negativo en el instante t0 la salida pasa a nivel alto y el transistor de descarga se bloquea permitiendo al condensador C1 comenzar a cargarse a travs de R1. Cuando C1 se ha cargado hasta 1/3 de Vcc la salida pasa de nuevo a nivel bajo en T1 y Q1 entra en conduccin inmediatamente descargndose C1. La velocidad de carga de C1 determina cunto tiempo va estar de salida en alta.
Publicado por Miguel Delgado en 10:08 Enviar por correo electrnicoEscribe un blogCompartir con TwitterCompartir con Facebook Etiquetas: 555, monoestable
555
El temporizador 555 es un dispositivo muy utilizado, este puede ser configurado de dos maneras distintas como multivibrador monoestable o como multivibrador a estable (oscilador). En la siguiente imagen mostraremos los componentes internos del temporizador 555 el cual consta de comparadores los cuales tiene una salida en alto cuando la tensin de entrada en el punto positivo es mayor en el punto negativo, en caso contrario la salida estar en un nivel bajo. Tambin tiene un divisor de tensin formado por tres resistencias de 5 K esta proporciona un nivel de disparo de un tercio de voltaje de fuente y un nivel umbral de dos tercios de voltaje de entrada.
Diagrama funcional interno de un temporizador 555
Descripcin del temporizador 555 GND ( 1): polo negativo de la alimentacin, generalmente se conecta tierra.
Disparo ( 2): Aqu se establece el inicio del tiempo de retardo, si el 555 es configurado como monostable. Este proceso de disparo ocurre cuando este pin esta puesto a un voltaje por debajo del nivel de 1/3 del voltaje de alimentacin. Este pulso debe ser de corta duracin, pues si se mantiene bajo por mucho tiempo la salida se quedar en alto hasta que la entrada de disparo pase a alto otra vez. Salida ( 3 ): En este pin veremos el resultado de la operacin del temporizador, ya sea que est conectado como monostable, astable u otro. Cuando la salida es alta, el voltaje ser el voltaje de alimentacin (Vcc) menos 1.7 Voltios. Esta salida se puede obligar a estar en casi 0 voltios con la ayuda de la patilla de reset (normalmente la 4). Reset ( 4 ): Si se pone a un nivel por debajo de 0.7 Voltios, pone la patilla de salida a nivel bajo. Si por algn motivo esta patilla no se utiliza hay que conectarla a Vcc para evitar que el 555 se "resetee".
Control de voltaje ( 5 ): Cuando el temporizador se utiliza en el modo de controlador de voltaje, el voltaje en esta patilla puede variar casi desde Vcc (en la prctica como Vcc -1 voltio) hasta casi 0 V (aprox. 2 Voltios). As es posible modificar los tiempos en que la salida est en alto o en bajo independiente del diseo (establecido por los resistores y condensadores conectados externamente al 555). El voltaje aplicado a la patilla de control de voltaje puede variar entre un 45 y un 90 % de Vcc en la configuracin monostable. Cuando se utiliza la configuracin astable, el voltaje puede variar desde 1.7 voltios hasta Vcc. Modificando el voltaje en esta patilla en la configuracin astable causar la frecuencia original del astable sea modulada en frecuencia (FM). Si esta patilla no se utiliza, se recomienda ponerle un condensador de 0.01F para evitar las interferencias. Umbral ( 6 ): Es una entrada a un comparador interno que tiene el 555 y se utiliza para poner la salida a nivel bajo. Descarga ( 7 ): Utilizado para descargar con efectividad el condensador externo utilizado por el temporizador para su funcionamiento. Vcc, alimentacin ( 8 ): Es el pin donde se conecta el voltaje de alimentacin que puede variar de 4.5 voltios hasta 18 voltios (mximo).
El temporizador 555 es un circuito integrado extremadamente verstil que puede utilizarse para construir un montn de circuitos diferentes. Usted puede utilizar el 555 efectivamente sin entender la funcin de cada pin en detalle. Con frecuencia, el 555 se utiliza en astable el modo de generar una serie continua de pulsos, pero tambin se puede usar el 555 para hacer un one-shot o monoestable circuito. El 555 puede fuente o sumidero 200mA de corriente de salida, y es capaz de conducir amplia gama de dispositivos de salida.

Funcionamiento como monoestable Funcionamiento como astable
Publicado por Miguel Delgado en 08:35 Enviar por correo electrnicoEscribe un blogCompartir con TwitterCompartir con Facebook Etiquetas: diagrama 555, funcionamiento 555, multivibrador
VIERNES, 27 DE ABRIL DE 2012
Divisores de frecuencia con flip flop

Una aplicacin de los flip flop es la divisin de la frecuencia de la seal entrante .Al poner el flip flop JK en estado de basculacin (J=K=1) y aplicamos un tren de impulsos a la entrada del reloj la salida de Q es tambin un ten de impulsos con el doble de periodo y la mitad de frecuencia de la seal de entrada del clock. Entonces podemos usar para dividir la frecuencia en dos o en mltiplos de dos haciendo ms conexiones entre flip flop JK en estado de basculacin. Por ejemplo si nos pidieran implementar un divisor de frecuencia con flip flops JK activado por flanco negativo capaz de dividir la frecuencia de entrada en ocho.
Entonces haramos las siguientes conexiones con cuatro flip flops JK activado por flanco negativo tal como se muestra en el grfico siguiente:
Como se observa en el grafico si tomamos a Q0 como LSB y a Q3 como MSB y formaremos lo siguiente:
Hexadecimal 0 1 2 3 4 5 6 7 8 9 10 11 12 13 14 15
Q3 0 0 0 0 0 0 0 0 1 1 1 1 1 1 1 1
Q2 0 0 0 0 1 1 1 1 0 0 0 0 1 1 1 1
Q1 0 0 1 1 0 0 1 1 0 0 1 1 0 0 1 1
Q0 0 1 0 1 0 1 0 1 0 1 0 1 0 1 0 1
Notamos que hemos generado un contador binario capas de contar hasta 1111 16 en decimal y ademas que sigue un ciclo repetitivo.
Publicado por Miguel Delgado en 20:01 Enviar por correo electrnicoEscribe un blogCompartir con TwitterCompartir con Facebook Etiquetas: aplicacion flip flop, contador, jk
Flip flop maestro esclavo

Los flip flops maestro-esclavo son construidos a partir con dos flip flops, uno sirve de maestro y otro de esclavo. Durante la subida del pulso de reloj se habilita el maestro y se deshabilita el esclavo a travs de la compuerta not puesta a la entrada del clock del segundo flip flop. Los datos de entrada se transmiten a la salida del flip flop maestro. Cuando el pulso baja nuevamente a cero se deshabilita el maestro lo cual evita que lo afecten las entradas externas y se habilita el esclavo. Entonces el esclavo pasa al el mismo estado del maestro.
Publicado por Miguel Delgado en 17:46 Enviar por correo electrnicoEscribe un blogCompartir con TwitterCompartir con Facebook
Flip flop D
FLIP
TABLA
ECUACION Q(t+1)=D
Flip flop T
flip flop
tabla
ecuacion
Flip flop J K
flip flop
TABLA
ecuacion
JUEVES, 26 DE ABRIL DE 2012
Flip flop S R
flil flop tipo SR
tabla
ECUACION
Flip flop
Los flip flop son dispositivos sncronos de dos estados (estado alto o estado bajo), tambin conocidos como multivibradores biestables. La salida de estado cambia de manera sincronizada con el pulso de reloj. Un flip flop de disparo por flanco cambia de estado cambia de estado don el flanco positivo (flanco de subida) o con el flanco negativo (flanco de bajada) del impulso de reloj y solo es sensible a sus entrada solo en esa transicin del reloj.
Detector de flancos
Los Flip-Flop son unidades bsicas de todos los sistemas secuenciales, existen cuatro tipos: el SR, el JK, el T y el D. Y los ltimos tres son implementados a partir del primero.
En los flip flops mostrados los de la parte superior son de flanco negativo y los de la parte inferior son de flanco positivo

Flip flop SR Flip flop JK Flip flop T Flip flop D Flip flop Maestro-Esclavo Divisores de frecuencia con flip flop
Latch
El lacht o cerrojo es un dispositivo lgico capaz de almacenar temporalmente dos estados debido a su sistema de realimentacin Lacth S R ( Set Reset) Existen dos tipos de latch S R, uno con entrada activa en alto que compone de dos compuertas NOR y otro con entrada se activa en bajo, formado por dos compuertas NAND. La salida esta conectada ala entrada de las compuertas, lo cual genera la realimentacin o feedback.
Para e analizis tomaremos el latch sr con entrada en alto.
Se debe tener en cuenta para el analizis que existe transitorios a la salida antes del resultado final.
Ecuacin caracterstica del LATCH S-R:
comparadores
sumadores de acarreo serie y acarreo anticipado

sumador binario en paralelo

sumadores
demultiplexor
multiplexor
codificador
decodificador
mapa de karnao
CMOS triestado
Nor CMOS
Nand CMOS
Not CMOS
CMOS
JUEVES, 19 DE ABRIL DE 2012
Uso TTL
TTL triestado y schottky

Publicado por Miguel Delgado en 18:58
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puertas TTL en colector abierto

TTL nand
TTL not
TTL
Parmetros de corriente y voltaje de un CI

circuitos integrados
algebra de boole
Puertas logicas
MIRCOLES, 18 DE ABRIL DE 2012
Codigo Hamming
Mtodo de paridad
Codigo Gray
BCD
Conversion binario a decimal - decimal a binario

REGISTRO
Un registro de desplazamiento es un circuito digital secuencial (es decir, que los valores de sus salidas dependen de sus entradas y de los valores anteriores) estn conformados por un conjunto de flip flop, generalmente de tipo D, conectados en cascada. Son muy importantes para almacenar y desplazar datos dentro de un sistema digital.
Fip flop tipo D
La capacidad de almacenamiento de un registro es la cantidad total de bit que pueda guardar. Cada etapa del registro est compuesta por un flip flop el cual puede contener un bit por lo que su capacidad est determinada por el nmero de etapas. Dependiendo del tipo de entradas y salidas, los registros de desplazamiento se clasifican como:
1. 2. 3. 4.
Registros con entrada serie y salida serie (SISO) Registros con entrada serie y salida paralelo (SIPO) Registros con entrada paralelo y salida serie (PISO) Registro de entrada y salida en paralelo
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Diagrama funcional interno de un temporizador 555

Funcionamiento como monoestable Funcionamiento como astable

Divisores de frecuencia con flip flop

Flip flop maestro esclavo

VIERNES, 20 DE ABRIL DE 2012

Para e analizis tomaremos el latch sr con entrada en alto.

Ecuacin caracterstica del LATCH S-R:

sumadores de acarreo serie y acarreo anticipado

sumador binario en paralelo

TTL triestado y schottky

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