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Universidade Federal do Rio Grande do Norte Instituto Metrpole Digital Departamento de Informtica e Matemtica Aplicada IMD0021 Organizao e Arquitetura

a de Computares

Princpios de funcionamento de computadores e Tendncias Tecnolgicas


Monica Pereira1 e Rafael Aroca2 1monicapereira@dimap.ufrn.br 2rafael@imd.ufrn.br

PRINCPIOS DE FUNCIONAMENTO

Anatomia de um computador

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Contexto da Disciplina

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Arquitetura de Von Neumann (1945)


Com raras excees, todos os computadores atuais possuem essas mesmas funes e estrutura geral e assim so conhecidos como mquinas com arquitetura de Von Neumann (ou simplesmente mquinas de Von Neumann).

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Modelo de Von Neumman (Organizao)


Bloco de Controle Bloco Operativo Memria E/S Bloco de
Controle

BO

Entrada
Sada

Memria
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Modelo de Von Neumman (Organizao)

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Arquitetura de Harvard
Utiliza memrias separdas:
Instrues Dados

O acesso a estas memrias feito por barramentos distintos Vantagem


Possvel ler/escrever instrues e dados concorrentemente (ao mesmo tempo)

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Modelo de Harvard

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Mquinas No-Von Neumann


Mquinas paralelas: vrias unidades de processamento executando programas de forma cooperativa, com controle centralizado (SIMD ou MIMD) Mquinas de fluxo de dados: no executam instrues de um programa; realizam operaes de acordo com a disponibilidade dos dados envolvidos
Redes neurais artificiais: no executam instrues de um programa; resultados so gerados a partir de respostas a estmulos Processadores sistlicos: processamento ocorre pela passagem de dados por arranjo de clulas de processamento executando operaes bsicas

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Modelo de Von Neumann


:: Caractersticas Memria dividida em palavras e contm dados e instrues, indistintamente.

Palavra a unidade bsica de transferncia de / para memria. Palavras so localizadas atravs de um endereo. Programa uma sequncia de instrues, colocadas numa sequncia de endereos. A execuo de um programa corresponde execuo sequencial de suas instrues. Dados, instrues e endereos so codificados em binrio.
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Modelo de Von Neumann


:: Execuo de Instrues

Busca da prxima instruo na memria

Manda endereo, volta instruo

Decodificao da instruo

Interpreta cdigo da instruo

Execuo da instruo

Executa aes especficas para cada instruo

Se a instruo precisa de dados (na memria)

Manda endereo, busca dado

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Modelo de Von Neumann


:: Exemplo de Execuo de Instrues
Instruo de soma de dois operandos:

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Modelo de Von Neumann


:: Aspectos Temporais Uma instruo:

Um ou vrios acessos memria

Tempo de execuo de uma instruo:

Praticamente igual soma dos tempos de acesso memria.

Tempo de acesso memria principal:

Da ordem de 10 a 20 ns

Tempos de micro-operaes (somas, transferncias entre registradores, etc.)

So bem menores
Clock de 1 GHz representa ciclo de micro-operaes de 1 ns
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Modelo de Von Neumann


:: Gargalo

Trfego de informaes (endereos, dados, instrues) entre CPU e memria

Vai endereo da instruo

Volta instruo, que contm cdigo da operao e endereos dos operandos


Vo endereos dos operandos

Vo e voltam operandos
Instrues precisam especificar endereos dos dados e podem ocupar 2 a 3 palavras

2 a 3 acessos memria na busca da instruo

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Modelo de Von Neumann


:: Problemas e Solues Tempo de execuo da instruo fica comprometido pelo (a)

Sequencialidade das operaes Excesso de informaes transferidas entre processador e memria Tempo de acesso memria Diminuir o gargalo, diminuindo quantidade de informaes a serem transferidas entre processador e memria. Diminuir tempo aparente de acesso memria. Realizar operaes em paralelo. Tecnologia Organizao Arquitetura

Solues:

Dimenses de projeto que podem ser otimizadas:


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Modelo de Von Neumann


:: Diminuindo o gargalo

Incluso de memria cache:

Tempo de acesso compatvel c/ tempo de execuo das micro-operaes


Tamanho bem menor do que a memria principal

Introduo de registradores:

Dados utilizados frequentemente no precisam ser trazidos/levados de/para memria a cada utilizao.
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Aumentando o desempenho

Introduo de paralelismo: Na busca de instrues:

Pr-fetch, buffer de instrues


Pipeline Superescalaridade

Na execuo de instrues:

Arquitetura Harvard: memrias separadas para dados

e instrues

Acessos paralelos

Processadores RISC Muitos registradores Instrues mais simples e mais rpidas


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DESAFIOS DO PROJETO HW/SW

www.tomshardware.com

www.tomshardware.com

Multifuncionalidade

Processamento de Vdeo

Processamento de voz

Video Conferncia Processamento de Vdeo Reconhecimento de Imagens

Realidade Virtual

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Multifuncionalidade

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Multicore

http://software.intel.com/en-us/articles/intel-xeon-phi-coprocessor-codename-knights-corner IMD0021 Monica Pereira/Rafael Aroca 24

Manycore

http://news.cnet.com/8301-13512_3-10388025-23.html

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Heterogeneidade

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Heterogeneidade

data-flow

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Heterogeneidade

control-flow

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Heterogeneidade
heterogneo

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Reduo do tamanho do transistor

2 300 transistores 12 volts

230 000 000 transistores 1.2 volts

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Desafios das novas tecnologias


Ano de produo ITRS Nmeros (nm)

1995

1998

2000

2002

2003

2004

2006

2007

2009

2010

2012

2013

2015

2016

2018

2019

2022

350

250

180

130

100

90

70

65

50

45

36

32

25

22

18

16

11

Fonte: ITRS Executive Summary 2007

Technology

Density (device/cm2)

Circuit Speed

Switching Energy

Comparison

CMOS
FET SET

10 G
4.5G - 6.1G 60 G

61GHz
61GHz 1GHz

3 aJ
3 aJ >15 aJ Smaller Larger/Slower/Hotter

Molecular
Ferromagnetic

1T
5G

1GHz
10MHz

50 aJ
10 aJ

Larger/Slower/Hotter
Smaller/Slower/Hotter

Fonte: ITRS Emerging Research Devices 2007

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TENDNCIAS TECNOLGICAS

System-on-Chip
Multiprocessor System-on-Chip (MPSoC)
Paralelismo

Networks-on-chip
Comunicao

Memria compartilhada x distribuda Arquiteturas Dedicadas Arquiteturas Reconfigurveis

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Para saber mais ...


PATTERSON, D.A. & HENNESSY, J. L. Organizao e Projeto de Computadores A Interface Hardware/Software. 3 ed. Campus, 2005. Captulo 1

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Nas prximas aulas ...

Conjunto de Instrues Operaes e Operandos

Representao de instrues.

Modos de endereamento.

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