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1). compuertas: NAND, NOR, OR-EXCLUSIVA Y NOR-EXCLUSIVA

Compuerta NAND (NO Y) La compuerta NAND, es simplemente la negacin de la compuerta AND

La tabla de verdad de NAND es contraria o invertida a la de la compuerta AND, quedando que la salida solo ser un 0 cuando todas sus entradas estn en 1. El pequeo crculo en su salida es el que simboliza la negacin. El nmero de entradas debe ser como mnimo de dos, pero no es raro encontrar NAND de 3 o ms entradas.

Tabla de verdad de NAND:

Su smbolo normalizado sera el siguiente, tambin se muestra el smbolo antiguo en desuso que no debe utilizarse:

Controladores lgicos programables PLC I 2014 JESUS JOAQUIN CORONEL SANCHEZ

Compuerta NOR (NO O): Una compuerta NOR es la negacin de una compuerta OR, obtenida agregando una etapa NOT en su salida.

la negacin se expresa en los esquemas mediante un crculo en la salida. El nmero de entradas tambin puede ser mayor a dos.

En la tabla de verdad, la salida de una compuerta NOR es 1 solamente cuando todas sus entradas son 0 Tabla de verdad NOR.

Su smbolo normalizado sera el siguiente, tambin se muestra el smbolo antiguo en desuso que no debe utilizarse:

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Compuerta XOR (O Exclusivo): En una compuerta XOR la salida ser 0 siempre que las entradas sean distintas entre s. Ejemplo, si se tratase de la operacin XOR, la salida S seria 1 solamente si A=1 y B=0 A=0 y B=1, pero la salida S seria 0 si ambas entradas son iguales, si A=0 y B=0 A=1 y B=1.

Tabla de verdad XOR.

La salida es 1 solo cuando las entradas son diferentes. Su smbolo actual y el smbolo antiguo en desuso es:

Compuerta NXOR (No O Exclusivo) una compuerta NXOR no es ms que una XOR con su salida negada, por lo que su salida estar en estado alto solamente cuando sus entradas son iguales, y en estado bajo para las dems combinaciones posibles.

Tabla de verdad NXOR XNOR A 0 0 1 1 B 0 1 0 1 S 1 0 0 1

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Su smbolo actual y el smbolo antiguo en desuso es:

2). Para el siguiente diagrama, realice la tabla de verdad; tenga en cuenta que son cinco entradas y una salida.

Solucin:

Q= (( i1 . i2 ) + i5 ) . i3 . i4

i1 0 0 0 0 1 0 0 1 1 1 1 1

i2 0 0 1 1 0 0 0 1 1 1 1 1

i5 0 1 0 1 1 1 1 1 1 1 1 0

i3 0 0 0 0 0 1 1 1 0 1 0 0

i4 0 0 0 0 0 0 1 1 0 0 1 0

Q 0 1 0 1 1 0 0 0 1 0 0 1

3). Realice la tabla de verdad para el siguiente esquema

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Solucin: ( A . B ) + ( A . B) = Z

A 0 0 1 1

B 0 1 0 1

Z 1 0 0 1

4). Implemente un circuito mediante la utilizacin de interruptores que simule una compuerta OR exclusiva.

B C +

5). Represente grficamente la siguiente funcin mediante la utilizacin de compuertas lgicas: F = (BA + CB)*A

B A

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