Memorias de

Semiconductor
Departamento de Electrnica
Curso 2010/11
2010/11

ndice

Introduccin

Clasificacin de las memorias

El chip de memoria

Estructura interna de una

memoria

Cronogramas de acceso

Memorias RAM estticas

Memorias RAM dinmicas

Memorias ROM

Memorias PROM

Memorias E/EEPROM

Memorias FLASH

Expansin de memorias

Mapas de memoria

Gestin de la memoria

Ordenacin de datos en

memoria

Sistemas Electrnicos Digitales I

Departamento de Electrnica

Expansin de memorias: tamao

A partir de chips de memoria se puede ampliar:


El nmero de bits por palabra

Memoria de 1Kx8
A[9:0]

D[3:0]

Memoria
1Kx4

A[9:0]

D[7:0]

Memoria Memoria
1Kx4
1Kx4

Sistemas Electrnicos Digitales I

Departamento de Electrnica

Expansin de memorias: nmero

A partir de chips de memoria se puede ampliar:


El nmero de palabras
Memoria
de 2Kx4

A[9:0]

D[3:0]

Memoria
1Kx4
A[10:0]

D[3:0]

Memoria
1Kx4
Memoria
1Kx4

Sistemas Electrnicos Digitales I

Departamento de Electrnica

Expansin de memorias: tamao y nmero

A partir de chips de memoria se puede ampliar:


El nmero de bits por palabra y el nmero de palabras

Memoria de 2Kx8

A[9:0]

D[3:0]

Memoria Memoria
1Kx4
1Kx4
A[10:0]

D[7:0]

Memoria
1Kx4
Memoria Memoria
1Kx4
1Kx4

Sistemas Electrnicos Digitales I

Departamento de Electrnica

Expansin de memorias: ejemplo tamao

Memoria de 1Kx12 con

memorias de 1Kx4

Sistemas Electrnicos Digitales I

Departamento de Electrnica

Expansin de memorias: ejemplo nmero (I/II)

Memoria de 2Kx4 con

memorias de 1Kx4

Sistemas Electrnicos Digitales I

Departamento de Electrnica

Expansin de memorias: ejemplo nmero (II/II)

Memoria de 20Kx8 con

memorias de 4Kx8

Sistemas Electrnicos Digitales I

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Expansin de memorias: ejemplo tamao y nmero

Memoria de 4Kx8 con

memorias de 1Kx4

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Mapas de memoria (I/V)

Definicin: cantidad de memoria que se puede direccionar desde un uP y
organizacin/distribucin/estructuracin de la misma

2 tipos de mapa:



Lgico: Uso de las posiciones de memoria. P.ej. cdigo, datos, pila, etc.
Fsico: Implementacin fsica (en distintos chips) del mapa. P. ej. 2 chips de RAM
de 8K8, 1 chip de Flash de 32Kbytes, etc.

La definicin del mapa de memoria posibilita la conexin del uP al

sistema de memoria. Para ello:

1. Definir el mapa lgico a partir de la aplicacin y el fsico a partir del lgico

2. La definicin del mapa fsico permite conocer las direcciones para las que se accede
a cada chip GENERACIN DE LA LGICA DE DECODIFICACIN
3. Implementacin y conexin de los distintos chips de memoria y la lgica de
decodificacin al uP
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10

Mapas de memoria (II/V)

Ejemplo de mapa de memoria

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11

Mapas de memoria (III/V)

A partir del mapa fsico se hace una tabla de verdad para disear la

lgica de decodificacin

Del ejemplo anterior:

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Mapas de memoria (III/V)

A partir del mapa fsico se hace una tabla de verdad para disear la

lgica de decodificacin

Del ejemplo anterior:

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13

Mapas de memoria (IV/V)

A partir de la tabla de verdad de la lgica de decodificacin se

implementa el circuito de decodificacin:



Con puertas lgicas

Con decodificadores

Con una combinacin de ambos

Introduccin
los Sistemas
Electrnicos
Digitales
SistemasaElectrnicos
Digitales
I
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de Electrnica
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de Electrnica

14

Mapas de memoria (V/V)

Decodificacin completa:


Se emplea este trmino cuando el acceso a una posicin concreta de memoria se puede
realizar slo para una nica combinacin de los bits del bus de direcciones:
{una posicin fsica = una direccin lgica}

Decodificacin incompleta:


Se corresponde a aquella situacin en la que el acceso a una posicin concreta de memoria

se puede producir con varias combinaciones diferentes de los bits del bus de direcciones:
{una posicin fsica = varias direcciones lgicas}

En cualquier caso es necesario tener en cuenta la direccin base. Reconocer la funcin de

los diferentes bits de direcciones.
P.e. para el elemento (pastilla RAM de 8 Kbytes) las lneas A[12..0] se necesitan para seleccionar
la posicin deseada dentro del chip, y por tanto pueden presentar cualquier cdigo, lo que se
representa como XX...X.
El resto de las lneas A[15..13], para que la direccin presente en el bus se corresponda a este
chip, deben presentar el cdigo 1 1 0 ", 0xC000 a 0xDFFF
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15

Gestin de la memoria (I/III)

De qu depende? Es funcin del nmero de bits del bus de

datos externo del P, la estructura de la memoria puede ser de

diversos modos
1.

bus de datos de 8 bits,

nico banco (grupo) de
bytes..

Direccin de
la palabra

Banco nico

Byte 0

Byte 1

Byte 2

 Primera palabra

....
N-1

Byte (n-1)

Byte (n)

FF..FF

FF..FF

 ltima palabra

Organizacin en bytes de la memoria de un sistema con

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16

Gestin de la memoria (II/III)

2.

Bus de datos externo de 16 bits (aunque internamente sean 32)



Al leer o escribir a la memoria se puede hacer de 16 en 16 bits

La memoria se organiza en dos bancos: el par y el impar

Se debe permitir acceder a datos de uno y dos bytes

Direccin de
la palabra

Banco Par

Banco Impar

Byte 0

Byte 1

Byte 2

Byte 3

Byte (n-2)

Byte (n-1)

Byte (n)

Byte (n+1)

FF..FE

FF..FE

FF..FF

 Primera palabra

....
N-2

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 ltima palabra

17

Gestin de la memoria (III/III)

3.

Bus de datos externo de 32 bits



La memoria se estructura en 4 bancos

Se deben permitir los accesos a uno, dos y cuatro bytes

Direccin de la
doble palabra
0
4

Banco 0

Banco 1

Banco 2

Banco 3

Byte 0

Byte 1

Byte 2

Byte 3

Palabra (Word) 4

Palabra (Word) 6

Doble Palabra (Longword) 8

....

....

....

....

....

N-4

Byte (n-4)

Byte (n-3)

Byte (n-2)

Byte (n-1)

Palabra (N)

N+4
....

 Primera palabra

Palabra (N+2)

Doble Palabra (N+4)

....

....

....

....

FF..F8

FF..F8

FF...F9

FF..FA

FF..FB

FF..FC

FF..FC

FF..FD

FF..FE

FF..FF

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 ltima palabra

18

Ordenacin de los datos en memoria (I/III)

Queda por determinar de los varios bytes que componen el dato cul

representa el de mayor peso, los de pesos intermedios y el de menor



Big endian. Este tipo de ordenacin hace corresponder el byte de menor peso del
dato con el almacenado en la celda de memoria de direccin ms alta, dentro de las
que contienen el dato
Banco Par
0

Banco Impar

Dato de 8 bits

Dato de 8 bits

....
N-2

Dato de 16bits,
MSB

Dato de 16bits,
LSB

Dato alineado

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19

Ordenacin de los datos en memoria (II/III)



Little endian. Este tipo de ordenacin hace corresponder el byte de menor peso
del dato con el almacenado en la celda de memoria de direccin ms baja, dentro
de las que contienen el dato

En cualquier caso las celdas de memoria donde se encuentra almacenado el dato

han de ser consecutivas
Banco Par
0

Banco Impar

Dato de 8 bits

Dato de 8 bits

....
N-2

Dato de 16bits,
LSB

Dato de 16bits,
MSB

Dato alineado

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20

Ordenacin de los datos en memoria (III/III)

Banco 0
0

Banco 1

Banco 2

Dato de 8 bits

Banco 3
Dato de 8 bits

Dato de 8 bits

Dato de 8 bits

Dato de 16bits,
MSB

Dato de 16bits,
LSB

Dato de 16bits,
MSB

Datos alineados

Dato de 16bits,
LSB

Dato de 16bits,
MSB

Dato de 16bits,
LSB

Datos no
alineados

Dato de 32bits

Dato de 32bits

Dato de 32bits,
MSB

Datos alineados

Dato de 32bits,
LSB

Dato de 32bits

Dato de 32bits

Dato de 32bits,
LSB

Dato de 32bits

....
N-2

Dato de 16bits,
LSB

N
N+2
Dato de 16bits,
MSB

Dato de 32bits,
LSB

Dato de 32bits,
MSB

N+1
6

Dato de 32bits

Dato de 32bits,
MSB

Dato de 32bits

Dato de 32bits

Datos no
alineados

Dato de 32bits,
LSB
Dato de 32bits,
MSB

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