INSTITUTO TECNOLGICO SUPERIOR

DE LA MONTAA
INGENIERA EN SISTEMAS COMPUTACIONALES

ASIGNATURA: PRINCIPIOS ELCTRICOS Y APLICACIONES

DIGITALES

DOCENTE: ING. JACOBO REYES MATINEZ

TEMA: UNIDAD 4. LENGUAJES HDL

ACTIVIDAD: INVESTIGACIN.

PRESENTA: VILLEGAS GONZLEZ JESS

N CONTROL: S15120011

SEMESTRE: 4 SEMESTRE

TLAPA DE COMONFORT, GRO., A 08 DE AGOSTO DE 2017.

 PRINCIPIOS ELCTRICOS Y APLICACIONES DIGITALES
INVESTIGACIN

UNIDAD IV: LENGUAJES HDL

4.1. Dispositivos lgicos programables

Definicin 1:

Un Dispositivo Lgico Programable (PLD) es un componente electrnico usado

para construir circuitos digitales reconfigurables. A diferencia de una compuerta
lgica que tiene una funcin fija, los PLDs salen de fbrica sin una funcin en
especfico, por lo tanto, necesitan ser programados o reconfigurados antes de
poder ser usados.

Los PLDs tienen varias ventajas. La primera es la habilidad de integracin, que

permite integrar una gran cantidad de funcionalidad en un solo chip. Los PLDs
eliminan el uso de mltiples chips as como la inconveniencia y desconfianza de
usar cableado externo. La segunda ventaja es el hecho de poder cambiar el
diseo.

Muchos PLDs permiten ser reprogramados o reconfigurados. Existen dos ramas

principales dentro de los dispositivos lgicos programables, la lgica
programable de campo y la de fbrica. El trmino campo en este contexto
implica que los dispositivos puedan ser programados en el campo del usuario,
mientras que la lgica de fbrica puede ser programada en la misma fbrica
donde se construyen, de acuerdo a los requerimientos del cliente. En este caso,
la tecnologa de programacin usa procesos irreversibles, por lo que solo es
posible hacerlo una vez.

Definicin 2:

Qu es la lgica programable?

La lgica programable, como el nombre implica, es una familia de

componentes que contienen conjuntos de elementos lgicos (AND, OR, NOT,
LATCH, FLIP-FLOP) que pueden configurarse en cualquier funcin lgica que el
usuario desee y que el componente soporte. Hay varias clases de dispositivos
lgicos programables: ASICs, FPGAs, PLAs, PROMs, PALs, GALs, y PLDs complejos.

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Definicin 3:

La lgica programada es un tipo de diseo implementado en chips que permite

la reconfiguracin de los circuitos con el simple cambio del software que
incorpora, es lo contrario de la lgica cableada.

La lgica programada se basa en dispositivos lgicos programables (PLD), los

cuales tienen una funcin no establecida, al contrario que las puertas lgicas
que tienen una funcin fija en el momento de su fabricacin. Antes de poder
utilizar el PLD en un circuito, este debe ser programado.

A continuacin, muestro una imagen (figura 2.1) en la cual se plasma los tipos
de dispositivos programables y una breve descripcin que en el tema siguiente
abarcar con un poco ms a detalle cada uno.

4.1.1. Tipos

Algunos ejemplos de lgica programable de fbrica son los MPGAs y memorias

de slo lectura (ROMs). Las primeras generaciones de muchos dispositivos
programables tambin fueron programadas nicamente en fbrica.
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Las ROMs:

son consideradas como lgica programable porque, aunque fueron

concebidas como unidades de memoria, tambin sirven para implementar
cualquier circuitera combinacional.

Una ROM consiste en un arreglo de dispositivos semiconductores que estn

interconectados para almacenar de datos binarios. Una vez almacenada la
informacin, puede ser leda cuando se requiera, pero no puede ser
modificada bajo condiciones normales de operacin. Las ROMs tienen
combinaciones de entradas, que generalmente son llamadas direcciones, y
patrones de salidas, llamadas palabras. Una ROM que tiene n lneas de entrada
y m lneas de salida contiene un arreglo de 2n palabras, cada una de m bits de
longitud. La direccin sirve para seleccionar una de las 2n palabras, por lo que
cuando una combinacin de entrada es aplicada a la ROM, el patrn de ceros
y unos almacenados en la palabra correspondiente aparece en las lneas de
salida.

Una ROM consiste bsicamente de un decodificador y un arreglo de memoria.

Cuando un patrn de entrada se aplica a las entradas del decodificador, una
de las 2n salidas de dicho decodificador se activa, seleccionando una de las
palabras almacenadas en la memoria y se transfiere a las lneas de salida.

Los MPGAs

son arreglos de compuertas tradicionales que requieren una mscara para ser
diseados. Los MPGAs son tambin llamados simplemente gate arrays y han

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sido la tecnologa popular para crear ASICs (Application Specific Integrated

Circuits).

Los SPLDs

Los PLAs, PALs, GALs y ROMs son llamados SPLDs (Simple Programmable Logic
Devices) a partir del surgimiento de los CPLDs (Complex Programmable Logic
Devices) los cuales bsicamente contienen mltiples PLDs en el mismo chip.

Un CPLD

Los avances en tecnologa han hecho posible la creacin de circuitos

integrados programables equivalentes a varios PLDs en el mismo chip. A estos
circuitos integrados se les llaman dispositivos lgicos programables complejos
(CPLDs por sus siglas en ingls). Un CPLD es un circuito integrado que consiste en
un nmero de bloques lgicos parecidos a un PAL, incluyendo adems una
matriz programable de interconexiones entre estos bloques.

Algunos CPLDs se basan en la arquitectura del PAL, en cuyo caso cada

macrocelda contiene un flip flop y una compuerta OR, cuyas entradas estn
asociadas a un arreglo de compuertas AND fijo, mientras que los CPLDs que se
24 basan en PLAs cada salida de compuertas AND en un bloque se puede
conectar a la entrada de cualquier compuerta OR en ese bloque.

Los FPGAs

Los FPGAs son circuitos integrados que contienen un arreglo de bloques lgicos
idnticos con interconexiones programables, en los que el usuario puede
programar tanto las funciones realizadas por cada bloque lgico como las
conexiones entre bloques.

Los FPGAs tienen varias ventajas con respecto a MPGAs. Un arreglo de

compuertas tradicional puede ser usado para implementar cualquier circuito,
pero 27 slo se puede programar en fbrica ya que se requiere hacer una
mscara especfica para un circuito en particular y el tiempo de diseo para un
circuito integrado basado en arreglo de compuertas es de algunos meses. Por
otro lado, los FPGAs son productos comerciales, el tiempo de manufactura se
puede reducir de meses a algunas horas cambiando de MPGAs a FPGAs. De la
misma forma, se vuelve ms fcil y ms barato corregir errores en los diseos. A
volmenes no tan altos, los FPGAs son ms baratos que los MPGAs.
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El interior de los FPGAs contiene tpicamente tres elementos programables: los

bloques lgicos, los bloques de entrada/ salida y las interconexiones. Se
considera que los bloques de entrada/ salida se encuentran en la periferia del
circuito integrado, stos conectan las seales lgicas a los pines del chip. Los
bloques lgicos se encuentran distribuidos dentro del FPGA y el espacio entre
ellos se usa para mandar conexiones entre bloques.

4.1.2. caractersticas

El principio de sntesis de cualquier dispositivo lgico programable se

fundamenta en el hecho de que cualquier funcin booleana puede ser
expresada como una suma de productos. el dispositivo programable ms
simple es el pal (programmable array logic). el circuito interno de un pal
consiste en un arreglo, o matriz, de compuertas and y un arreglo de compuertas
or. el arreglo and es programable mientras que el or generalmente es fijo.
mediante una matriz de conexiones se seleccionan cuales entradas sern
conectadas al arreglo and, cuyas salidas son conectadas al arreglo or y de esta
manera obtener una funcin lgica en forma de suma de productos. una matriz
de conexiones es una red de conductores distribuidos en filas y columnas con
un fusible en cada punto de interseccin.

Algunas caractersticas son:

Los dispositivos lgicos Se experimenta con tarjetas de

Programables (PLD) son una
alternativa tecnolgica al diseo
electrnico tradicional.
Se requiere de destreza en la
programacin
desarrollo, que son costosas.
Es ms confiable la electrnica
del circuito.
El producto final es menos caro

Se requieren de dispositivos de La salida al mercado del

programacin producto es rpida.

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4.1.3. Fabricantes

Principales fabricantes:

Altera Lattice Semiconductor

Atmel Xilinx

Cypress Semiconductor

4.1.4. Pasos para el diseo con PLDs

Son IC's estndar de la familia de ASICs que estn disponibles en

configuraciones estndar desde catlogos de partes y se venden en grandes
volmenes a muchos consumidores. Sin embargo, los PLD's pueden configurarse
o programarse para crear partes configurables para una aplicacin especfica,
los PLD's utilizan diferentes tecnologas para permitir la programacin del
dispositivo.

Entre las principales caractersticas de los PLD's se puede destacar:

No poseen Un solo gran bloque lgicas que

mascaras o capas de interconexiones usualmente consiste
ni celdas lgicas programables. de un arreglo
configurables. programable lgico
Poseen una matriz seguido por un flip-
Rpido diseo. de macroceldas flop o latch
Planificacin del diseo

Para poder atacar un problema complejo (sistema) la mejor manera que

tenemos es dividirlo. De esta manera se pueden atacar problemas de menor
complejidad y mas fciles de analizar. Este es el camino que generalmente
usamos para disear un sistema digital.

Las decisiones que se tomen al principio para dividir el problema pueden

afectar el resultado final. En algunos casos debemos volver al principio y
replantear la arquitectura despus de haber resuelto el problema. La
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experiencia y conocimientos sobre el problema, las posibles soluciones y la

tecnologa disponible ayudarn a que la decisin que se tome sea la ms
acertada.

Un sistema puede estar compuesto por varios subsistemas, no todos ellos

digitales o electrnicos. La primera decisin ser entonces que partes del
sistema se implementarn como subsistemas digitales. En el sistema digital, los
siguientes pasos se siguen en cada nivel de la jerarqua del diseo, cada vez
con mayor nivel de detalle.

La especificacin es muy importante pare definir bien los lmites de lo que se

quiere fabricar. A partir de la especificacin se puede definir una arquitectura
con los diferentes componentes que implementan cada funcin del sistema.
Para el diseo se debe definir el funcionamiento de cada uno de esos
componentes.

Un sistema digital y sus componentes pueden definirse a distintos niveles de

abstraccin y en tres dominios diferentes: Comportamiento, estructural y fsico.

Dominio Comportamiento: Describe lo que hace un sistema (funcionamiento)

Nivel Algoritmo: Describe el comportamiento del sistema como operaciones

sobre las entradas para producir las salidas deseadas sin detallar los cambios en
el tiempo ni las seales internas.

Nivel RTL: Describe el comportamiento de todas las seales (entradas, internas y

salidas) en el tiempo (para cada ciclo de reloj en sistemas sincrnicos)

Dominio Estructural: Describe al sistema como una interconexin de

componentes (esquemtico)

Nivel P-M-S (Processor Memory Switch): Describe la estructura como la

interconexin de elementos de procesamiento, memoria e interconexin, sin
mayores detalles de implementacin.

Nivel Registros: Describe la estructura como la interconexin de registros y lgica

de interconexin.

Dominio Fsico: Describe la implementacin fsica del sistema (plano).

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Para lograr tiempo ms rpidos de diseo, menos errores, y mayor

productividad, lo ideal sera poder trabajar al mximo nivel de abstraccin
posible (algoritmos), sin entrar en los detalles de bajo nivel.
Desafortunadamente, esto no es siempre posible con la tecnologa existente
(pero esta cambia permanentemente). El nivel de abstraccin depender
entonces de la aplicacin y restricciones sobre el diseo.

Si se debe disear un integrado full-custom analgico es probable que se

trabaje al nivel de ecuaciones diferenciales, al nivel de transistores y haciendo
el layout manual. Si se disea un integrado digital con bloques predefinidos (IP,
Cores) y adquiridos a terceros se trabajar a un nivel de abstraccin mucho
mayor (floorplanning, RTL).

En el ciclo de diseo con FPGAs, gran parte del aspecto fsico ha sido
solucionado por el fabricante. En general se trabaja al nivel de transferencia de
registros con algunas herramientas que ayudan a disear a niveles de
algoritmo.

4.2. Programacin de circuitos combinacionales con HDL

Programacin de circuitos combinacionales con HDL Los circuitos

combinacionales son aquellos cuyo valor de saluda depende nicamente
de los valores de entrada:

Comparadores Multiplexores Decodificadores

Sumadores Codificadores Convertidores de

cdigo

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4.2.1. POR CAPTURA ESQUEMTICA

Por Captura Esquemtica se entiende el proceso de descripcin, mediante un

dibujo, de un circuito elctrico, en el que se representan a los diferentes
componentes del circuito y solo se efectan interconexiones entre ellos.

Existen varios programas con la aplicacin de Captura Esquemtica como el

Schematic del IspStarter de Lattice Semiconductor o Fundation de XILINX
entre otros. Esta tcnica permite simular en la computadora el circuito
virtualmente y verificar su funcionamiento antes de su fabricacin o
implementacin en un PLD, reduciendo as el ciclo de diseo y el tiempo de
obtencin de un producto.

Programa de Captura Esquemtica. Los cuatro componentes bsicos de la

captura esquemtica son: Smbolos, Conectores, Etiquetas y Puertos de Entrada
y/o Salida.

4.2.2 Por tabla de verdad

Para aclarar el proceso es necesario un ejemplo especfico, la tabla de

verdad especifica un circuito combinacional con dos entradas y dos salidas. Las
funciones de BOOLE pueden expresarse en suma de trminos mnimos. El diseo
de circuitos combinacional es parte la especificacin del problema y culmina
en un diagrama lgico de circuitos o un conjunto de funciones booleanas a
partir de las cuales se puede obtener ediagrama lgico.

El procedimiento implica los pasos siguientes:

De la Deduzca la tabla simplificadas para

especificacin del de verdad que cada salida en
circuito, deduzca el define la relacin funcin de
nmero requerido requerida entre las variables de
de entradas y entradas y las entrada.
salidas; salidas.
Dibuje el diagrama
asigne un smbolo a Obtenga las lgico y verifique
cada una. funciones que el diseo sea
booleanas correcto

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4.2.3 Por ecuaciones Booleanas

Si se requiere reducir la funcin que realiza el circuito. Este proceso parte del
diagrama lgico dado y culmina en un conjunto de funciones BOOLEANAS, una
tabla de vedad o una posible explicacin del funcionamiento del circuito. Si el
diagrama lgico analizar va acompaado de un nombre de funcin o de una
explicacin de lo que se supone que hace, el problema de anlisis se reduce a
una verificacin de la funcin planeada.

El anlisis se efecta manual mente encontrando las funciones BOOLEANAS o la

TABLA De VERDAD, o bien utilizando un programa de simulacin de
computadora.

El primer paso del anlisis consiste en asegurarse del que el circuito dado
sea combinacional y no secuencial. El diagrama del circuito combinacional
tiene compuertas lgicas sin trayectoria de retroalimentacin ni elementos de
memoria. Una trayectoria de retroalimentacin es una conexin de salida de
una compuerta a la entrada de una segunda compuerta que forma parte de
la entrada a la primera compuerta.

4.2.4 Por descripcin de comportamiento

Por descripcin de comportamiento. El modelado comportamental, describe el

funcionalmente de un circuito. Se trata de una descripcin funcional por que
expone la forma en que trabaja el circuito, es decir, las descripciones
consideran la relacin que hay entre las entradas y las salidas del circuito, sin
importar como est organizado en su interior

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4.3 Programacin de circuitos secuenciales con HDL

Lenguaje de Descripcin de Hardware de alta escala de integracin (VHDL)

VHDL es el acrnimo que representa la combinacin de VHSIC y HDL,

donde VHSIC es el acrnimo de Very High Speed Integrated Circuit y HDL es a
su vez el acrnimo de Hardware Description Language.

Es un lenguaje definido por el IEEE (Institute of Electrical and Electronics

Engineers) (ANSI/IEEE 1076-1993) usado por ingenieros para describir circuitos
digitales. Otros mtodos para disear circuitos son la captura de esquemas (con
herramientas CAD) y los diagramas de bloques, pero stos no son prcticos en
diseos complejos.

Otros lenguajes para el mismo propsito son Verilog y ABEL.

Aunque puede ser usado de forma general para describir cualquier circuito
se usa principalmente para programar PLD (Programable LogicDevice -
Dispositivo Lgico Programable), FPGA (Field Programmable Gate Array), ASIC y
similares Dentro del VHDL hay varias formas con las que podemos disear el
mismo circuito y es tarea del diseador elegir la ms apropiada.

Funcional: Describimos la forma en que se comporta el circuito. Esta es la

forma que msse parece a los lenguajes de software ya que la
descripcin es secuencial.

Estas sentencias secuenciales se encuentran dentro de los llamados

procesos en VHDL. Los procesos son ejecutados en paralelo entre s, y en
paralelo con asignaciones concurrentes de seales y con las instancias a
otros componentes.

Flujo de datos: Describe asignaciones concurrentes (en paralelo) de

seales.

Estructural: se describe el circuito con instancias de componentes. Estas

instancias forman un diseo de jerarqua superior, al conectar los puertos
de estas instancias con las seales internas del circuito, o con puertos del
circuito de jerarqua superior.

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Mixta: combinacin de todas o algunas de las anteriores.

En VHDL tambin existen formas metdicas para el diseo de mquinas
de estados, filtros digitales, bancos de pruebas etc.

4.2.1. Por captura esquemtica

Los programas de captura esquemtica son aplicaciones creadas para esbozar

circuitos electrnicos y exportar los esquemas como archivos netlist ; los cuales
satisfacen la sintaxis de algn ncleo de simulacin en particular.

Dentro de este grupo de programas, que delegan al usuario la tarea de enlazar

los archivos netlist generados con el ncleo de simulacin, se encuentran:
XCircuit 11, y gschem 12; pertenecientes a los grupos Open Circuit Design y
gEDA , respectivamente. La principal caracterstica de ambos programas, es
que pueden generar dibujos decircuitos de gran calidad, debido a la
tecnologa utilizada en su implementacin: el lenguaje Postscript para la
descripcin de diagramas.

Sin embargo, se aprecia una ligera diferencia entre estas dos aplicaciones,
locual podra ayudar a discriminar entre una y otra. Por una parte, el autor de
gschem reconoce que XCircuit produce mejores salidas grcas; y por otra,
gschem est ms orientado al diseo de circuitos que a dibujos de calidad en
s, lo cual se aprecia en su funcionalidad. Lamentablemente, la desventaja de
programas de este tipo, es el hecho de tener que enlazar explcitamente el
ncleo de simulacin; lo cual incrementa la curva de aprendizaje de usuarios
provenientes de ambientes ms amigables

4.3.2.POR TABLA DE VERDAD

La tabla de verdad es un instrumento utilizado para la simplificacin de circuitos

digitales a travs de su ecuacin booleana.

Las tablas de verdad pueden tener muchas columnas, pero todas las tablas
funcionan de igual forma. Hay siempre una columna de salida (ltima columna
a la derecha) que representa el resultado de todas las posibles combinaciones
de las entradas.

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El nmero total de columnas en una tabla de verdad es la suma de las entradas

que hay + 1 (la columna de la salida).

El nmero de filas de la tabla de verdad es la cantidad de combinaciones que

se pueden lograr con las entradas y es igual a 2n, donde n es el nmero de
columnas de la tabla de verdad (sin tomar en cuenta la columna de salida)

Ejemplo: en la siguiente tabla de verdad hay 3 columnas de entrada, entonces

habrn:

2^3 = 8 combinaciones (8 filas)

Un circuito con 3 interruptores de entrada (con estados binarios "0" o "1"), tendr
8 posibles combinaciones. Siendo el resultado (la columna salida) determinado
por el estado de los interruptores de entrada.

4.3.3. POR ECUACIONES BOOLEANAS

Los Nmeros Reales lo conocemos muy bien, as como todas las operaciones
definidas en l. Estamos acostumbrados a trabajar con ellos desde pequeos,
por eso este tipo de Ecuaciones nos parecen intuitivas y sencillas, aunque no
comprendamos lo que significan las variables usadas.

Sin embargo, puesto que estos nmeros vienen expresados en binario, las
variables y nmeros utilizados NO SON REALES.

Para describir un circuito digital utilizaremos ecuaciones, Para describir un

circuito digital utilizaremos ecuaciones matemticas.

Sin embargo, estas ecuaciones tienen variables y nmeros que NO SON REALES,
por lo que NO podemos aplicar las mismas propiedades y operaciones que
conocemos.

Hay que utilizar nuevas operaciones y nuevas propiedades, definidas en el

ALGEBRA DE BOOLE.

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4.3.4. POR DESCRIPCIN DE COMPORTAMIENTO

Descripcin VHDL de comportamiento. Esta es quizs la etapa ms importante

del diseo, ya que en ella se toman decisiones claves para el resultado final.

El mtodo se clarifica con un ejemplo, en el cual se ha buscado tambin la

aplicacin de los criterios de jerarqua, modularidad y regularidad. Para ello se
trata de que todos los pasos de la secuencia sean iguales, cuando ello es
posible.

Tambin se siguieron las recomendaciones de no usar lgica auxiliar en las

seales de reloj (todos los cambios del sistema se producen sincronizados con la
seal de reloj la cual es nica para todos los Flip Flops.) Sntesis. Ya en la
descripcin inicial se halla presente la divisin del circuito en una parte de
control y una parte de datos.

Por lo tanto, la sntesis consistir en pasar de la descripcin de comportamiento

a una descripcin de estructura (y comportamiento) que contemple los
requisitos expuestos.

En esta etapa son importantes la eleccin del tipo de lgica a utilizar y la

estrategia de reloj, esto se podr apreciar en el ejemplo que consiste en un
circuito de control para un convertidor A/D de aproximaciones sucesivas.
Comportamiento.

En una especificacin de este tipo decimos cual es la funcin que cumple el

sistema.

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4.3.5. Por tabla de estado

Una tabla de estado es un listado que contiene la secuencia de los estados de

entradas, estados internos y salidas del sistema, considerando todas las posibles
combinaciones de estados actuales y entradas. Las tablas de estado por lo
general se dividen en tres partes:

Estados actuales Estados siguientes Salidas

A continuacin, muestro un ejemplo con las valores.

Las ecuaciones lgicas en los circuitos secuenciales tienen una estructura

formada por dos clases se estados:

Los estados siguientes, los cuales se agrupan al lado izquierdo de la

expresin y representan las variables dependientes del sistema. El estado de
estas variables cambia en el momento que ocurra una transicin en la seal
de reloj.

Estados actuales y entradas del sistema. Agrupados al lado derecho de la

expresin, constituyen las variables independientes, las cuales pueden o no
cambiar en sincrona con el sistema.

Cuando las ecuaciones de estado contienen varios trminos, se puede

simplificar empleando metodologas de reduccin de trminos como Algebra
Boole, Mapas de Karnaugh o mediante el algoritmo de Quine-McCluskey.

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4.3.6. Por diagrama de transicin

Circuitos secuenciales

Son aquellos en los cuales las salidas en un instante de tiempo determinado

dependen de las entradas en ese instante y en instantes anteriores de tiempo.

Como consecuencia de la definicin anterior podemos llegar a la conclusin

de que este tipo de circuitos son capaces de memorizar informacin y que esta
informacin en un momento dado depende de las entradas ocurridas en el
circuito hasta ese momento.

El circuito no es capaz de memorizar todas las entradas ocurridas hasta un

instante de tiempo determinado, sino solo una cierta parte. A la informacin
almacenada se le denomina estado del sistema, y el nmero mximo de
informaciones almacenables es el nmero de estados posibles del sistema.

El circuito secuencial recibe informacin binaria de su ambiente a travs de las

entradas E, las cuales, en combinacin con el estado actual Q (t) (almacenado
en los elementos de almacenamiento), determinan el valor binario de las salidas
S y el siguiente estado Q(t+1). Las salidas de un circuito secuencial son las
salidas del circuito combinacional.

Funciones de transicin

Un circuito o sistema secuencial queda definido por dos funciones lgicas,

llamadas funciones de transicin:

1. Funcin de salida: nos indica cmo depende la salida o salidas, de las

entradas actuales y del estado actual.

2. Funcin de transicin de estado: nos indica como depende el nuevo estado

del estado anterior y de las entradas al sistema.

Funcin de salida:

S(t) = salidas en el mismo instante de tiempo t

E(t) = entradas en el mismo instante de tiempo t

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Q(t) = estado en el instante de tiempo t

La funcin de salida puede expresarse:

S (t) = F [ E (t), Q (t)]

Funcin de transicin de estado

Nos indica si unas determinadas entradas producen un cambio en el estado y a

qu estado se cambia. La funcin puede expresarse:

Q(t+1) = G [ E(t), Q(t) ]

Tanto F como G son funciones lgicas, exactamente iguales a las estudiadas

hasta ahora. La nica novedad, que confiere a los circuitos secuenciales
propiedades totalmente distintas a los combinacionales, es el hecho de que
existe realimentacin. La funcin G nos da los valores Q en funcin de los
propios valores Q anteriores. Las mismas variables son variables de entrada y
salida de la funcin.

Las funciones F y G pueden expresarse mediante tablas de verdad. como

cualquier otra funcin. Por el hecho de existir realimentacin, se les denomina
tablas de transicin del circuito secuencial.

Cronogramas

Cuando ste es complejo, es ms cmodo manejar una representacin grfica

de las variables en funcin del tiempo. A esta representacin se le llama
cronograma. Ms adelante veremos los cronogramas de los distintos biestables.

Biestables

Los biestables son circuitos lgicos capaces de permanecer en uno de entre

dos estados estables, an despus de desaparecer la causa que provoc el
paso al estado alcanzado. Son, pues, capaces de almacenar una informacin
binaria (1 bit).

Tipos de biestables.

Deben distinguirse tres aspectos en las seales de entrada que producen la

transicin de un estado a otro:

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1. La lgica de disparo, que determinar que el biestable cambie de estado

cuando en sus entradas se d una cierta combinacin de seales. Es el modo
de funcionamiento. Puede haber tantos biestables como lgicas de cambio
nos imaginemos. En la prctica slo se usan 4 tipos de biestables.

2. El tipo de disparo, que determinar la forma en que las excitaciones de

entrada afectan al estado del biestable.

3. El sincronismo en el disparo, que determinar si el funcionamiento del

biestable se har de acuerdo con la presencia de una seal adicional a las
entradas, y que se denomina seal de reloj.

Combinando estos tres aspectos, los fabricantes han comercializado una gran
variedad de biestables, que son suficientes para las necesidades de diseo.
Podemos clasificar los biestables segn estos criterios.

1. Atendiendo a la lgica de disparo (modo de funcionamiento):

q Biestable R-S

q Biestable J-K

q Biestable D

q Biestable T

2. Atendiendo al sincronismo en el disparo y tipo de disparo:

Asncronos (latches): funcionan sin seal de reloj.

Sncronos (flip-flops): funcionan con seal de reloj.

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Disparo por nivel de tensin: alto ("1") o bajo ("0")

Nivel alto ("1"): El biestable podr cambiar de estado cuando la seal de reloj
est a "1".

Nivel bajo ("0"): El biestable podr cambiar de estado cuando la seal de

reloj est a "0".

Disparo por flanco: de subida o bajada

Flanco de subida: El biestable podr cambiar de estado en el instante en que

la seal de reloj pase de "0" a "1".

Flanco de bajada: El biestable podr cambiar de estado en el instante en

que la seal de reloj pase de "1" a "0".

Biestables asncronos (latches)

Asncronos quiere decir que funcionan sin seal de reloj; cualquier cambio en
las entradas produce un cambio en las salidas, en cualquier momento. En el
caso de tener varios biestables asncronos en un circuito, cada uno actuara de
forma independiente a los otros.

Biestables sncronos (flip-flops)

Son los que funcionan en sincronismo con una seal de reloj. A estos tambin se
les llama circuitos secuenciales sincronizados, y es el tipo de circuito ms
utilizados en la prctica, ya que son relativamente sencillos de disear.

Un circuito secuencial sncrono emplea seales que afectan los elementos de

almacenamiento slo a instantes discretos de tiempo.

La sincronizacin se logra por medio de un dispositivo de sincrona, llamado

generador de reloj, que produce un tren peridico de pulsos de reloj, a
intervalos fijos.

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Esto significa que en los biestables sncronos, la tabla de transicin solo se

cumple cuando se activa la seal de reloj. Si la seal de reloj no se activa, no se
produce ninguna transicin. Por tanto, aunque en las entradas haya una
combinacin de seales que conduzcan a una transicin de estado, sta no se
producir hasta que se active la seal de reloj, y no volver a producirse una
nueva transicin hasta que se active de nuevo la seal de reloj.

La seal de reloj puede activarse de dos formas: por nivel o por flanco.

Biestables activados por nivel (de tensin):

Un biestable activado por nivel podr cambiar de estado cuando la seal de

reloj est a un determinado nivel de tensin: "1" (nivel alto) o "0" (nivel bajo).

Biestables activados por flanco:

Un biestable activado por flanco ignora el pulso de reloj mientras est en un

nivel constante y se dispara slo durante una transicin de la seal de reloj, de
"0" a "1" (flanco de subida) o de "1" a "0" (flanco de bajada).

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INVESTIGACIN

Material bibliogrfico consultado

a) http://electronicaintegradalmec.blogspot.mx/2008/02/dispositivos-

logicos-programables.html

b) http://mitecnologico.com/sistemas/Main/FabricantesDispositivosLogicosPr

ogramables

c) http://iindustrial.obolog.es/dispositivos-logicos-programables-parte-1-

209085

d) http://bioingenieria.edu.ar/academica/catedras/electronica_digital/arch

ivos/teorias/plds.pdf

e) http://principioselectricos2015its.16mb.com/4-3-5-Por-tabla-de-estado/

f) http://cdigital.dgb.uanl.mx/te/1020149162.pdf

g) https://es.scribd.com/doc/292412432/Unidad-4-Lenguajes-HDL

h) http://www.ptolomeo.unam.mx:8080/jspui/bitstream/132.248.52.100/658/8

/A8.pdf

i) http://pablin.com.ar/electron/cursos/intropld/index.htm

j) http://itpn.mx/recursosisc/4semestre/principioselectricos/Unidad%20IV.pdf

k) http://principioselectricosits.16mb.com/ar/4-1-2-Caracter%C3%ADstica
21
 PRINCIPIOS ELCTRICOS Y APLICACIONES DIGITALES
INVESTIGACIN

l) http://bioingenieria.edu.ar/academica/catedras/electronica_digital/arch

ivos/teorias/plds.pdf

m) http://electronicwebeasy.es.tl/PASOS-PARA-EL-DISE%D1O-DE-DLP.htm

n) http://electronicwebeasy.es.tl/PROGRAMACION-DE-CIRCUITOS-

COMBICIONALES-CON-HDL.htm

o) http://electronicwebeasy.es.tl/POR-TABLA-DE-ESTADO-CIRCUITOS-

SECUENCIALES.htm

p) https://es.scribd.com/doc/292412432/Unidad-4-Lenguajes-HDL

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