Microcontroladores

Família 80xx

07/03/2018
Campus Mossoró, Eng Msc Kleber Jacinto

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 Arquitetura
Como a família Intel é organizada internamente

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Arquitetura
Como a família Intel é organizada internamente

Evolução

Microchip

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Barramento

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Barramento

0101111101
0101010000
1110011011
0101010101

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Barramento

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Barramento

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Arquitetura harvard

Mapeamento único de memória Mapeamento memória separados

para dados e instruções para dados e instruções

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Arquitetura harvard

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Arquitetura harvard

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Arquitetura Harvard – RISC x CISC

Reduced Instruction Set Computer ou Computador com um Conjunto Reduzido de Instruções

Um conjunto simples e pequeno de instruções
Mesmo tempo de execução
As instruções são executadas diretamente pelo hardware

Complex Instruction Set Computer ou Computador com um Conjunto Complexo de Instruções

Centenas de instruções complexas
Conjunto de códigos de instruções gravados no processador (microcódigo)
Código X Desempenho.

28
RISC  2x2x2x2x2x2x2x2  multiplicação = 1 ciclo por operação = 8 ciclos
CISC  28  potenciação = 10 ciclos por operação = 10 ciclos

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Ciclos

• Ciclo de Busca: Lê um byte (8 bits ou 8 dígitos) da memória, no endereço mapeado e

escrito no registrador contador de programa (PC) e armazena o byte no registrador de
instrução (IR). O byte é decodificado e interpretado. O PC é incrementado.

• Ciclo de execução: processamento (realização de operações lógicas e aritméticas, escrita

e leitura de registradores, entrada e saída de dados

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Encapsulamento

VQFN

TQFP

V
Q
F
N
SPDIP
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Arquitetura básica da família 8051

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Arquitetura básica da família 8051

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Arquitetura básica da família 8051

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