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PONTIFICIA UNIVERSIDA CATOLICA MADRE Y MAESTRA

FACULTAD DE CIENCIAS DE LA INGENIERIA


DEPARTAMENTO DE INGENIERIA ELÉCTRONICA Y
ELECTROMECÀNICA

ASIGNATURA:
ELECTRONICA DIGITAL
(ST-ITE-323-T-001)

PARCIAL No.:
3

TÍTULO:
SISTEMA DE SEGURIDAD

PRESENTADO POR:
JOAN E. PEÑA ACOSTA
JOEL G. MOREL INOA
JOSE D. SANCHEZ DOMINGEZ

MATRÍCULA:
2016-0335
2014-1107
2014-0773

PROFESOR:
ING. CESAR HERNÁNDEZ

FECHA DE ENTREGA:
03-08-2018

SANTIAGO DE LOS CABALLEROS, REPUBLICA DOMINICANA

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Tabla de contenido
Objetivos ........................................................................................................................ 3
Materiales y Equipos...................................................................................................... 3
Procedimiento ................................................................................................................ 5
Conclusión ................................................................................................................... 16

Tabla de imágenes
Imagen 1. Diagrama de la Alarma, primera parte .......................................................... 5
Imagen 2. Diagrama de la Alarma, segunda parte ......................................................... 5
Imagen 3. Diagrama de la Alarma, tercera parte ........................................................... 5
Imagen 4. Diagrama Completo ...................................................................................... 6
Imagen 5. DecoT ............................................................................................................ 8
Imagen 6. DecoX ........................................................................................................... 8
Imagen 7. On Delay ....................................................................................................... 9
Imagen 8. Registros y Contadores ................................................................................. 9
Imagen 9. Divisor de Frecuencia ................................................................................. 10
Imagen 10. Flanco Positivo.......................................................................................... 10
Imagen 11. Registro de Clave ...................................................................................... 11
Imagen 12. Comparador de Clave ............................................................................... 11
Imagen 13. Sonido ....................................................................................................... 12
Imagen 14. Máquinas de Estados ................................................................................ 12
Imagen 15. Control LCD ............................................................................................. 14

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OBJETIVOS:

General:
 Diseñar un sistema de seguridad con contraseña programable y pantalla LCD.

Específicos:
 Emplear lo aprendido durante el curso de Electrónica Digital.
 Diseñar y utilizar circuitos temporizados.
 Implementar el sistema en módulos de Verilog.
 Probar el funcionamiento del FPGA Spartan 3E XC3S500E.

Características:

 Utilizar una opción de introducir una clave. (ENTER)


 Tener un botón para cargar una nueva contraseña (LOAD) y otro que sea
capaz de borrarlos (RESET)
 Contar con la posibilidad de borrar o retroceder un valor de la pantalla de
manera que no sea visible. (BACK SPACE)

MATERIALES Y EQUIPOS

 FPGA Spartan 3E XC3S500E.


 Programa de diseño de módulos Xilinx ISE Webpack (código verilog).
 Programa de implementación de módulos Digilent Adept.
 Cables genéricos de conexión.
 Teclado matricial.
 Tablero del Digital Lab.

3
Introducción
En el presente informe se verán detalladamente las características y elementos
utilizados en el proyecto final de Electrónica Digital, el cual se basa en un “sistema
de seguridad con pantalla LCD” con distintas etapas, las cuales serán explicadas más
adelante.

Ahora bien, la lógica de este proyecto está basada en el funcionamiento de una alarma
real, donde sí se acciona un sensor debe activar un conteo regresivo con un tiempo
determinado para introducir la clave de seguridad, en caso de que no lo haga y el
tiempo se agote, se activara el sonido de la alarma y hasta no introducir la clave
correcta esta no dejara de sonar.

Para este proyecto, se pondrán en práctica los conocimientos aprendido a lo largo del
curso, ya que se utilizaran diferentes equipos o materiales tales como: FPGA, teclado
matricial 4x4, pantalla LCD, sensor, bocina , registros, multiplexores, y entre otros.
Además, se espera mejorar las habilidades en el manejo de “Xilink”, especialmente en
los módulos que requieren códigos “Verilog”, ya que su utilidad es de vital
importancia para el adecuado funcionamiento de este experimento.

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Procedimiento
El diagrama para el circuito de la alarma, se puede observar a continuación:

Imagen 1. Diagrama de alarma, primera parte.

Imagen 2. Diagrama de alarma, segunda parte.

Imagen 3. Diagrama de la alarma, parte tres.

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Diagrama completo.

Imagen 4. Diagrama completo

Nota: Si desea verlo perfectamente con excelente calidad y la posibilidad de hacer


zoom, diríjase a la sección de Códigos y haga “doble clic” sobre el icono de
diagrama, ya que se le abrirá el documento en otra ventana muy claro.

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Idea general del funcionamiento de la alarma

El funcionamiento de este sistema de alarma es el siguiente, una vez ya instalada la


alarma esta se activara mediante un sensor, este sensor mandara un 1 lógico a la
máquina de estado y se activara un conteo descendente del On Delay, este conteo
regresivo servirá para que se introduzca la clave mediante el decodificador de teclado
antes de que el conteo llegue a 0, esta clave digitada por el teclado será comparada
con una clave predeterminada guardada en un registro de 16 bits, en caso de que la
clave digitada por teclado sea incorrecta se procederá activarse el sonido de la alarma,
por otro lado si la clave digitada por teclado es correcta se desactiva el conteo del On
Delay y se desactiva el sensor, el usuario tendrá la opción de cambiar la clave una vez
la haya digitado correctamente la primera vez.

Las instrucciones a seguir se irán mostrando en forma de letreros en una pantalla


LCD, controlada por la segunda máquina de estados, los mensajes que se mostraran
serán los siguientes: “Activada”, ”Desactivada”, ”Digite clave”, “Clave correcta”,
“Clave error”, “Cambiar clave”, entre otros.

Por otro parte el teclado tendrá botones como” Backspace” y “Enter” para facilitar el
manejo al usuario a la hora de digitar la clave, el backspace funciona gracias a los
multiplexores que controlan a los registros, desplazando y simulando 0 para darle la
oportunidad de borrar si se equivoca y el enter para cargar los dígitos y proceder a
compararlos.

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Funcionamiento especifico de cada etapa del proyecto.

DecodT

Imagen 5. DecoT

Es el decodificador del teclado, el cual tiene como función distinguir y reconocer la


posición de la tecla en la cual ha sido pulsada. Es decir, que las entradas “Y” del
decodificador están conectadas al VCC y resistencias. Es importante decir, que las
entradas son activo bajo y se selecciona la posición en la cual se encuentra la tecla
pulsada.

Por otra parte, las entradas “X” son activos bajos y tienen como función transportar,
es decir, enviar el dato al decodificador. Por lo que, este dispositivo tiene como
ocupación transformar las entradas.

DecoX

Imagen 6- DecoX.

Es el decodificador del decoY. Donde, una de sus funciones es transformar la salida


del DecoY a un valor que se ingrese desde el teclado. Aunque, es importante tener en
cuenta que muchas veces se puede pulsar una tecla que tenga un valor diferente en las
entradas o salidas, es decir que se pulsa el número 4, este puede tener otro valor en
Hexadecimal.

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Sensor

El sensor está hecho con un Flip Flop tipo T. Si el sensor se activa, manda un 1 a la
salida, por lo tanto se activa el conteo para comenzar a sonar la alarma. También se
tiene otro flip flop para resetear el sensor cuando se comprueba que la clave ha sido
introducida correctamente. Este lo teníamos como alternativa, porque por asuntos de
tiempo, vamos a usar un switch del FPGA para simular el encendido y apagado del
sensor.

On Delay

Imagen 7. On Delay

Se encarga de abrir o cerrar determinados contactos temporizados, debidamente


preestablecidos. Ahora bien, el elemento crucial de un temporizador es un contador
binario el cual es encargado de medir los pulsos del reloj realizados por algún objeto
oscilador, el cual posee un tiempo estable y conocido.

Para este proyecto, cuando el sensor este “encendido”, este mandara un “1” lógico al
ON Delay, que hace que comience a contar descendente desde el tiempo determinado
por el usuario hasta 0. Es en ese tiempo, en el que se le tiene que poner la clave antes
de que la alarma comience a sonar, esto es en el caso de que se haya activado
accidentalmente.

Registros y multiplexores

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Imagen 8. Registros y Multiplexores.

Además utilizaremos 4 multiplexores 8a4 y 4 registros para cargar los datos pulsados
por el teclado, Estos datos también se pasaran a un comparador en el que se
compararan, para comprobar si la contraseña es correcta. La función de los registros
aparte de cargar los datos es permitir el desplazamiento de estos en el visualizador
dinámico con ayuda de los multiplexores.

Divisor de frecuencia

Imagen 9. Divisor de Frecuencia.

La necesidad de un divisor de frecuencia es porque ya que se tiene una señal y es la


misma señal de clock debe conducir circuitos en diferentes frecuencias, y porque es
más fácil para estabilizar el circuito. La salida de este divisor repartirá la el clock a
todos los circuitos necesarios para que estén sincronizados.

Flanco P

Imagen 10. Flanco Positivo.

El filtro flanco p se encargará de que cuando se pulse una tecla esta no se repita, ya
que al pulsar una tecla esta dará muchos pulsos hasta llegar a un momento estable y es
ahí donde entra el filtro. Este solo toma en cuenta el momento estable al pulsar la
tecla. Esta señal va conectada a la máquina de estado.

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Registro 16 bits

Imagen 11. Registro de Clave.

Este registro se utilizara para guardar una clave por defecto, que será la clave con la
que se comparará la clave introducida por teclado, esta clave también podrá ser
modificada siempre y cuando se introduzca inicialmente la clave correcta.

Comparador

Imagen 12. Comparador de Clave.

Este comparado recibirá los datos introducidos por el teclado y recibirá también los
datos guardados en le multiplexor de 16 bits, los comparará y entonces si es correcta
se refleja en la salida con que A=B daría un 1 en la salida. Este , “1”, le entra a la
máquina de estado principal (MEO), la cual afirma que se cumplió la condición del
estado “clave correcta” y asigna un valor decimal en “ea”, que será enviado a la
segunda maquina (ME1), donde esta mostrara en su pantalla el letreo adecuado, es
decir para “1” en la salida “Clave Correcta”. Ahora bien, para el caso donde en la
salida del comparador el valor es “0”, ósea no son iguales, se realizara el mismo
proceso mencionado, solo que la segunda máquina de estado (ME1), tendrá un nuevo
valor “ea” correspondiente a un nuevo letrero, el de “Clave Incorrecta”.

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Sonido

Imagen 13. Sonido.

La lógica del sonido es controlada principalmente por la máquina de estado (ME0) y


la salida del On Delay. Donde, si se acaba el tiempo de poner la clave, se manda una
señal para la bocina. Cabe destacar, que esta etapa por motivos de tiempo se puede
remplazar por solo encender un led del FPGA, cuando se active la salida del On
Delay.

Máquinas de estados

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Imagen 14. Máquinas de estados.

Máquina de Estado0 (ME0)

La máquina de estado se encargará de manejar todas las funciones. Será quien, de la


orden para activar y desactivar cada circuito o señal. Para facilitar el manejo del
proyecto decidimos utilizar 2 máquinas de estados, a continuación se explicaran cada
uno de los estados.

- El estado 0, es el estado por defecto, donde estarán desactivadas las mayorías


de señales en el programa, se dice la mayoría porque el ce1 debe está activo
porque se necesita que la máquina de estado 1 muestre el letrero
“Desactivada” en la pantalla LCD.

- El estado 1, es el estado de ingresar números, donde se utiliza la condición


que si el dato es menor a 9 pasa de estado y en lógica de salida se habilita ce
por el pulso de reloj. Se asume que ya el sensor se activó, entonces se activa el
conteo en el On delay, y se activa un letrero “Ingrese la clave” en la pantalla
LCD.

- El estado 2, es el estado enter de clave, se procede a cargar los datos en el


registro y estos pasaran al contador para ser comparados.

- El estado 3, en este se habilita el comparador y este procede a comparar el


dato ingresado con la clave por defecto.

- El estado 4, en caso de que sea la clave correcta la salida del comparador dará
un 1 y se desactiva el conteo del On delay y se le da el acceso a poder cambiar
la clave.

- El estado 5, significa que la salida del comparado es 0, por tanto la clave es


incorrecta, se mostrara un letrero “Error de clave” en la pantalla LCD , en caso
de que el On delay llegue a 0 sin introducir la clave correcta, se activara el
sonido de la alarma hasta que se introduzca la clave correcta.

- El estado 6, el usuario podrá utilizar el backspace para borrar el dato


introducido por el teclado e intentarlo nuevamente.
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- El estado 7, es el estado de reset que será utilizado para borrar los datos de los
registros.

- El estado 8, en caso de que se introduzca la clave correcta, se activara el


letrero “Cambiar la clave” para ofrecerle al usuario la posibilidad de cambiar
esta clave, esta se guardara en el registro de 16 bits.
Máquina de estado1 (ME1)

La segunda máquina de estado fue implementada por el hecho de que se hacía más
versátil a la hora de agregar más salida a la máquina de estado principal, así dejando
solo la 2 para las condiciones de cuales mensaje mostrar en la pantalla lcd.

Recibiendo una variable de la máquina de estado principal, el cual esta existe dentro
de todos los estados declarados asignándole un valor fijo. Cuando este valor fijo entra
a la segunda máquina de estado, esta se encarga de verificar que valor llego a ella
desde la primera máquina de estado para poder elegir el mensaje indicado. Ya que la
maquina principal es la encargada de saber todo lo que está haciendo, por esto se
decidió crearla de esta forma.

Una vez elegida la condición del estado actual, la segunda maquina procese a enviar
el mensaje a el modulo Control LCD.

Control LCD

Imagen 15. Control LCD.

Esta parte fue realizado por el profesor, y funciona con un modulo donde están los
letreros guardados, se asigna un pin al reset, ini y las posiciones del letrero. Se utiliza
un multiplexor antes de ir a la pantalla, que convierte ascii a lo pulsado por el
teclado, para cuando se mande o pulse “ini”, el multiplexor pueda dejar pasar los
letreros que estén almacenados.

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Códigos

(Doble Click para abrir) --- (Doble Click para abrir) --- (Doble Click para abrir)

PRINCIPAL.txt MAQUINA DE ESTADOS.txt controlLCD.v-1.txt Diagrama (1).html Diagrama (1).html

Nota: El diagrama es el mismo, solo que está disponible para abrirse en ambos navegadores.

Acuérdese profee, que el código completo de xilink ya se lo pasamos, estos son los que
pedían específicamente para este reporte.

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