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UNIVERSIDAD TÉCNICA DE AMBATO

FACULTAD DE INGENIERÍA EN SISTEMAS, ELECTRÓNICA E INDUSTRIAL

CARRERA DE INGENIERÍA EN ELECTRÓNICA Y COMUNICACIONES

VLSI

OCTAVO “A”

CONSULTA 04

TEMA:
MODELADO DE SISTEMAS SECUENCIALES

INTEGRANTES
 Bayas Gerardo
 Gualpa Thalía
 Pullutasig Jonathan
 Toapanta Carlos

Fecha de Envío: viernes, 14 de junio del 2019

Fecha de Entrega: viernes, 19 de junio del 2019

Docente: Ing. Edgar Patricio Córdova Córdova

MARZO - AGOSTO 2019

AMBATO - ECUADOR
2019
1. TEMA:
INSTANCIACIÓN

2. OBJETIVOS
a. OBJETIVO GENERAL:

 Indagar acerca de instanciaciones en VHDL.

b. OBJETIVOS ESPECÍFICOS:
 Investigar acerca de las instanciaciones en VHDL.
 Indagar acerca de port map y acerca de atributos
 Realizar un sumador y un contador mod16 usando las instanciaciones.

3. FUNDAMENTACIÓN TEÓRICA:

INSTANCIACIÓN:

Según Serafín Alfonso: Específica como las E/S del componente declarado son
conectadas en el diseño en que se utiliza el componente. La instanciación de
componentes es una proposición básica en una arquitectura estructural. Las
diferentes instancias son concurrentes una con otra. [1]

Según Santiago Fernández Gómez: Componente de una biblioteca que forma parte
de un circuito o sistema, al que se invoca mediante la propia declaración del
componente y una sentencia de instanciación en la que se asocian sus parámetros
formales con parámetros locales (literales, señales o expresiones en el nivel de
jerarquía desde el que Se instancia). Así, cada instancia al mismo componente puede
asociarse a diferentes parámetros locales. Ello facilita y reduce enormemente la
cantidad de código necesario para el modelado estructural de un sistema.

COMPONENETE:

Un componente representa un par de entidad / arquitectura. Especifica un subsistema,


que se puede crear una instancia en otra arquitectura, lo que lleva a una especificación
jerárquica. La creación de instancias de componentes es como conectar un
componente de hardware a un zócalo en una placa.

La instrucción de instanciación de componente introduce un subsistema declarado en


otro lugar, ya sea como un componente o como un par de entidad / arquitectura (sin
declararlo como un componente). Hay tres formas de instanciación de componentes:

 instanciación de un componente;
 instanciación de una entidad de diseño;
 instanciación de una configuración;

Componentes e instanciación directa de componentes:

Antes de que un componente pueda ser usado, éste debe ser instanciado. La
instanciación consiste en seleccionar una especificación compilada de la librería y
ligarla a la arquitectura donde será usada.

Cada instancia de un componente contiene dos partes:

nombre_de_la_instancia : entity

work.nombre_de_la_entidad ( nombre_de_la_arquitectura )

Donde “Work” es el nombre de la librería donde todos los elementos definidos por
el usuario son salvados.

Instanciación de un componente:

La creación de instancias de un componente introduce una relación con una unidad


definida anteriormente como un componente. El nombre del componente instanciado
debe coincidir con el nombre del componente declarado. El componente instanciado
se llama con los parámetros reales para genéricos y puertos. La lista de asociaciones
puede ser posicional o nombrada.

La instalación de una entidad de diseño.


No es necesario definir un componente para crear una instancia: entidad/arquitectura
se puede instanciar directamente. En una instanciación directa de este tipo, la
instrucción de instanciación del componente contiene el nombre de la entidad de
diseño y, opcionalmente, el nombre de la arquitectura que se utilizará para esta
entidad de diseño. La entidad de palabra reservada sigue la declaración de este tipo
de la declaración de creación de instancias del componente.

Si el nombre de la arquitectura no se especifica en una instanciación de una entidad


de diseño, se tomará la última arquitectura compilada asociada a la entidad. [2]

PORT MAP:

Los puertos en una declaración de componente generalmente deben coincidir con los
puertos en la declaración de la entidad uno por uno. La declaración del componente
define los nombres, el orden, el modo y los tipos de puertos que se utilizarán cuando
el componente se ejemplifique en el cuerpo de la arquitectura. Instanciar un
componente implica hacer una copia local de la entidad de diseño correspondiente:
un componente se declara una vez dentro de cualquier arquitectura, pero se puede
instanciar cualquier cantidad de veces.

Se utiliza un mapa de puertos para definir la interconexión entre instancias. Sintaxis:

port map ( [ port_name => ] expression, ... )

Un mapa de puertos asigna señales en una arquitectura a puertos en una instancia


dentro de esa arquitectura. Los mapas de puertos también pueden aparecer en un
bloque o en una configuración.

Las conexiones se pueden enumerar mediante asociación posicional o mediante


asociación nombrada. Dentro de una instancia, los nombres de los puertos son
puertos en el componente o entidad que está siendo instanciada, las expresiones son
señales visibles en la arquitectura que contiene la instancia. Dentro de una
configuración, los nombres de puertos son puertos en la entidad, las expresiones son
puertos en el componente.

Los elementos de un puerto de matriz se pueden conectar individualmente cuando se


usa una asociación nombrada. Los puertos pueden quedar desconectados con la
palabra clave abierta . [3]

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