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III. OBJETIVOS:
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Laboratorio Nº2 de Circuitos Digitales.
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Fig. 1 Compuertas Lógicas interruptores en paralelo, que sin importar cual se accione, será
posible el paso de la corriente.
Trabajan en dos estados, "1" o "0", los cuales pueden
asignarse a la lógica positiva o lógica negativa. El estado
1 tiene un valor de 5v como máximo y el estado 0 tiene
un valor de 0v como mínimo y existiendo un umbral
entre estos dos estados donde el resultado puede variar
sin saber con exactitud la salida que nos entregara. Las
lógicas se explican a continuación:
d. Compuerta NAND
También denominada como AND negada, esta
compuerta trabaja al contrario de una AND ya que al no
tener entradas en 1 o solamente alguna de ellas, esta
concede un 1 en su salida, pero si esta tiene todas sus
entradas en 1 la salida se presenta con un 0.
b. Compuerta OR
En el Algebra de Boole esta es una suma. Esta
compuerta permite que con cualquiera de sus entradas
que este en estado binario 1, su salida pasara a un
estado 1 también. No es necesario que todas sus Fig. 5 Tabla y Representación de la Compuerta
entradas estén accionadas para conseguir un estado 1 a NAND
la salida pero tampoco causa algún inconveniente. Para
lograr un estado 0 a la salida, todas sus entradas deben
estar en el mismo valor de 0. Se puede interpretar como dos e. Compuerta NOR
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Laboratorio Nº2 de Circuitos Digitales.
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Tabla 2.
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Figura 10. Circuito topológico equivalente para comprobar A B
fNOR(A,B)= A+B
tablas de verdad. 0 0 2.09 V
0 1 0.00 V
1 0 0.00 V
1 1 0.25 V
De los diagramas anteriores, se observa que en
el LED (diodo emisor de luz) D1 se comprobará la
compuerta Y de dos entradas; en D2 la tabla de verdad
Tabla 3.
de la compuerta NO-Y de 2entradas, y así
sucesivamente.
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A B
fAND(A,B)= A.B
A continuación se muestra la configuración interna de los
0 0 0.00 V
0 1 0.00 V
1 0 0.00 V
1 1 2.20 V
Tabla 4.
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A B
fOR(A,B)= A+B
0 0 0.00 V
0 1 1.87 V
1 0 1.87 V
1 1 1.87 V
Tabla 5.
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A B
fXOR(A,B)= A∎B
circuitos integrados usados en los diagramas 0 0 0.00 V
topológicos anteriores. 0 1 2.70 V
1 0 2.70 V
Figura 11. Configuración interna de los circuitos 1 1 0.30 V
integrados usados en los diagramas topológicos
anteriores.
VII. CUESTIONARIO:
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Laboratorio Nº2 de Circuitos Digitales.
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IX. REFERENCIAS:
[1] Análisis y Diseños de Circuitos Lógicos Digitales. Victor,P.N.
y Troy,H. y Bill, D. y David,J. Prentince Hall
Hispanoamericana, S.A.; Naucalpan de Juarez,Mexico:
Prentince Hall Hispanoamericana, S.A. (1996). (pag 418-
519).
[2] Fundamentos de sistemas digitales; Thomas,L.F. ;
PEARSON Prentice Hall; Madrid ;2006 ; (pag 448 – 451).
[3] Diseño Digital: Principios y Practicas; Jhon,F.W. ;Naucalpan
de Juarez, Mexico; 2000 ; (pag 796-799).
[4] The TTL Applications Handbook ; Peter,A. y Ib,L. ;Fairchild
Semiconductor; 1973.
[5] Sistemas Digitales: Principios y Aplicaciones; Ronald,J.T. y
Neal,S.W. y Gregory,L.M. ; Pearson Education ; Naucalpan
de Juarez,Mexico ;2007.
2018