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2-1 / 3 bits
1.2
4-1 / 8 bits
1.3
6-1 / 7 bits
2. Describa en VDHL un decodificador de 3 entradas utilizando la
sentencia with-select.
El diseño debe contener:
a. Una impresión de pantalla de la descripción en VHDL.
b. Una impresión de pantalla de la simulación, en el cual se debe
evidenciar el correcto funcionamiento del diseño.
Decodificador
SELECCIÓN SALIDA
E0 E1 E2 S6 S5 S4 S3 S2 S1 S0
0 0 1 0 0 0 0 0 0 1
0 1 0 0 0 0 0 0 1 0
1 0 0 0 0 0 0 1 0 0
1 0 1 0 0 0 1 0 0 0
0 1 1 0 0 1 0 0 0 0
1 1 0 0 1 0 0 0 0 0
1 1 1 1 0 0 0 0 0 0
SIMULACION
3. Describa en VDHL un codificador de 4 entradas, sin prioridad, utilizando la
sentencia with-select.
El diseño debe contener:
a. Una impresión de pantalla de la descripción en VHDL.
b. Una impresión de pantalla de la simulación, en el cual se debe evidenciar
el correcto funcionamiento del diseño.
4. Describa en VDHL el circuito que se muestra en la siguiente figura:
a. Utilizando la sentencia with-select.
b. Utilizando la sentencia when-else.
Figura 1
El diseño debe contener:
a. Un pantallazo de la descripción en VHDL.
b. Un pantallazo de la simulación, en el cual se debe evidenciar el correcto
funcionamiento del diseño.
Figura 2
Figura 3