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El modulo basico de reloj , soporta bajo costo del sistema y el consumo de ultra baja
energía. Usando tres señales de reloj internas, el usuario puede seleccionar el mejor
equilibrio entre rendimiento y bajo consumo de energía .
El módulo de reloj básico + puede ser configurado para funcionar sin ninguno de los
componentes externos , con una resistencia externa, con uno o dos cristales externos ,
o con resonadores , bajo control de software completo.
El módulo de reloj básico + incluye dos, tres o cuatro fuentes de reloj :
• XT2CLK : oscilador de alta frecuencia opcional que se puede utilizar con cristales
estándar , resonadores , o fuentes de reloj externas en los 400 kHz a rango de 16 MHz .
• MCLK: Reloj Maestro. MCLK es software seleccionable como LFXT1CLK, XT2CLK (si
esta disponible on-chip) o DCOCLK. MCLK se divide por 1, 2, 4, u 8. MCLK es utilizado
por la CPU y el sistema.
Después de un PUC, RSELx = 7 y DCOX = 3, lo que permite el DCO para iniciar a una
frecuencia de gama media. MCLK y MCLK se obtienen de DCOCLK.
• Los cuatro bits RSELx seleccionar uno de los dieciséis rangos nominales de
frecuencia para el DCO. Estos rangos son definido para un dispositivo individual en la
hoja de datos específicos del dispositivo.
• Los tres bits DCOX dividen el rango DCO seleccionados por los bits RSELx en 8
pasos de frecuencia, separados por aproximadamente el 10%.
• Los cinco bits MODx, pasar de la frecuencia seleccionada por los bits DCOX y el
siguiente más alto frecuencia fijada por DCOX 1. Cuando DCOX = 07h, los bits MODx
tiene ningún efecto porque el DCO es ya en la posición más alta para el rango RSELx
seleccionado.
Cada dispositivo MSP430F2xx (y la mayoría, ver hojas de datos específicos del
dispositivo) tiene la configuración de los registros DCOCTL y BCSCTL1 registro
calibrados para frecuencias específicas almacenadas en la memoria la información del
segmento A.
Para utilizar los ajustes calibrados, la información se copia en el DCOCTL y BCSCTL1
registros.
Los ajustes calibrados afectan al DCOX, MODx, y los bits RSELx y desactive todas las
otras partes, a excepción de XT2OFF que permanece activada. El resto de los bits de
BCSCTL1 pueden ajustarse o borrarse según sea necesario con BIS.B o instrucciones
BIC.B.
El modulador mezcla dos frecuencias del DCO, FDCO y FDCO+1 para producir una
frecuencia efectiva intermedia entre FDCO y FDCO+1, lo que reduce las interferencias
electromagnéticas (EMI). El modulador mezcla FDCO y FDCO+1 para DCOCLK de 32 ciclos
de reloj y está configurado con los bits de MODx. Cuándo el modulador está apagado
MODx = 0 .
• Fallo del oscilador de baja frecuencia (LFXT1OF) para LFXT1 en modo LF.