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Microcontroladores

Comunicacin serial

Se enva bit por bit

Es sncrono si se enva el pulso de reloj Es asncrona si no se enva el pulso de reloj

Jorge Antonio Reyes Avendao

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Comunicacin por el puerto serie RS232

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Secuencia de envo (recepcin)

1.- Se enva (espera) el bit de inicio , transicin de 1 (estado de espera) a 0 (estado de inicio). 2.- Se enva (recibe) bit a bit (comenzando por LSB) la palabra de 7 u 8 bits, cada uno con una duracin constante T. (Aqu se incluye el bit de paridad en caso de ser requerido). 3.- Se enva (recibe) el bit de fin de transmisin, un 1 lgica negativa con duracin de 1, 1.5 o 2 periodos.

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Estndar RS232
Usa una lgica negativa como lo indica la siguiente figura:

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Velocidad de transmisin
El estndar RS232 permite velocidades de transmisin de 75, 150, 300, 600, 1200, 2400, 4800 y 9600 baudios*. La velocidad de transmisin debe ser defina por programacin antes de realizar la comunicacin. * Un baudio equivale a transmitir un bit por segundo.

Conector DB-9

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Conversin entre niveles TTL y RS232 MAX232

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El Hyperterminal

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BUS I2C
Es un bus de comunicaciones SERIAL desarrollado por la empresa Phillips y que es usado como estndar en un gran nmero de aplicaciones. Aunque es ms lento que un Bus paralelo (velocidades menores a 100Kb/s) requiere poco hardware y un mnimo cableado, lo que lo hace ideal para aplicaciones con microcontroladores con puertos de salida son limitados.

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Microcontroladores Cada esclavo tiene una direccin definida y diferente Estructura del BUS I2C

SCL .- Serial Clock SDA.- Serial Data (bidereccional)


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Circuito maestro: Inicia y termina la transferencia de informacin adems de proporcional la seal de reloj, suele ser un microcontrolador. Circuito esclavo: circuito electrnico direccionado por el maestro, puede ser una memoria, una pantalla LCD, un termmetro electrnico, etc. Cada esclavo tiene una direccin definida y nica.
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HADWARE del BUS I2C


Las etapas de salida de cada circuito deben ser dren o colector abierto

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Transferencia de un bit por la lnea SDA


Un bit se transmite en el estado alto del pulso de reloj por la lneas SCL. Durante el estado alto el bit no debe cambiar, de lo contrario ser interpretado como una seal de inicio o paro. El cambio en el dato slo es permitido en el estado bajo de la seal de reloj.

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Inicio y paro de la comunicacin

1. Se inicia la comunicacin con un flanco de bajada en el estado alto del clk. 2. Se enva bit a bit en cada estado alto del clk. 3. Se termina la comunicacin con un flanco de subida en el estado alto del clk. Para iniciar la comunicacin todos los transistores deben estar en alta impedancia (BUS desocupado) . Cada dispositivo conectado al bus debe contar con el Hardware que le permita detectar las condiciones de paro e inicio.

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Transferencia de datos Cada dato consta de un byte (8 bits). Se pueden enviar varios bytes consecutivos por cada seal de inicio. Se manda primero el MSB (bit ms significativo). Una vez transmitido el dato, el receptor debe general una seal de reconocimiento (acknowledgement) en el noveno pulso de reloj. La seal consiste en poner en bajo la lnea SDA. Cada grupo de 8 bits debe ser reconocido (ACK). El emisor deja libre la lnea SDA en el noveno pulso de reloj para recibir el ACK.

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Si el receptor no desea recibir ms datos lo hace saber al emisor no generando el bit ACK en el noveno pulso de reloj, lo que es detectado por el emisor. Quien podr generar una seal de paro o una de inicio. Si un dispositivo esclavo no puede recibir o transmitir un byte de datos completo porque tiene que realizar un proceso interno, puede poner a bajo la lnea SCL lo que fuerza a el maestro a entrar en un estado de espera. Cuando el esclavo este listo para recibir o enviar ms datos debe liberar la lnea SLC ponindose en alta impedancia.

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Formato de transferencia de datos

1. Bit de inicio 2. 7 bits de direccin de esclavo 3. Bit de configuracin (R/W). 0 .- esclavo como receptor, 1.esclavo como emisor 4. Bit de reconocimiento CLK en el noveno pulso de reloj 5. Mensaje de 8 bits 6. bit de reconocimiento o bit de paro.
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Tipos de comunicacin

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Tipos de comunicacin

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Tipos de comunicacin

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Temporizacin
Thigh Sandard mode Fast mode High speed mode 100 Kb/s 400 Kb/s 3.4 Mb/s Tlow THD ;STD TSU;STO 4s 4.7s 4s 4.7s tHD;DAT tSU;DAT tBUF 5s 250ns 4.7s

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Conexin tpica

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Memoria EEPROM SERIE 24C256 Almacena hasta 32Kb


Voltaje de alimentacin de 2.5 a 5 V Contiene una interfaz I2C Bajo consumo de energa

3 pines para direccionamiento

Proteccin contra escritura

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Paginacin de la memoria 24LC256

Nmero de pgina

posicin de la palabra

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Direccionamiento como esclavo

Con A2, A3, A4 se pueden tener hasta 8 memorias conectadas en el mismo BUS El bit R/W indica si el micro va a escribir (0) o si va a realizar una lectura de memoria (1)
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Conexin al Pic16F84A

Lectura de memoria b10100001 Escritura de memoria b10100000


Proteccin de escritura desactivada

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Escritura en la memoria

Se pueden enviar hasta 64 bytes entre bit de inicio y paro, si se requieren enviar ms de 64, el micro-controlador debe iniciar una nueva conexin. Al indicar la primera direccin, automticamente sta se va incrementando con cada nuevo byte enviado.
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Lectura en la memoria
1.- El micro-controlador realiza un envo de direccin como si fuese a escribir 2.- El maestro enva una nueva condicin de inicio 3.- Luego enva el byte de control en modo de lectura 4.- El maestro lee el contenido de memoria, la posicin de la memoria se incrementa automticamente. 5.- Por ltimo el maestro enva la condicin de paro.

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Grabacin de datos en la memoria mediante el uso de un grabador.

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Antigua prctica de laboratorio

***Bienvenidos**** El dato en e puerto B es : X

El dato se enva a la pantalla con un switch conectado a RB0/INT

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Prctica de laboratorio

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