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Projeto Fnix
BRAZIL IP
Verso 0.6 | 13 de agosto de 2003 Responsveis: Carlos Eduardo Monteiro Rodrigues, Diogo Jos Costa Alves, Vtor Schwambach Costa
Microcontrolador 8051
Fnix Project
Histrico de Alteraes
Data Verso Descrio Autor
31/07/03 04/08/03
0.1 0.2
Especificao inicial dos casos de uso USART Modo 0 Transmisso e USART Modo 0 Recepo.
Especificao inicial dos casos de uso USART Modo 1 Diogo, Carlos, Transmisso, USART Modo 1 Recepo, USART Modo 2 Vtor Transmisso, USART Modo 2 Recepo, USART Modo 3 Transmisso e USART Modo 3 Recepo. Reviso tcnica e ortogrfica. Alteraes no fluxo de eventos de todos os casos de uso. Reviso tcnica e ortogrfica Insero das linhas Write_to_SBUF. de entrada State, Phase Carlos, Vtor Vtor Carlos, Vtor e Vtor
Lista de Aprovadores
Nome Cargo
USART
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Contedo
1. Caso de Uso USART Modo 0 Transmisso....................................................................................... 5 1.1 Convenes, termos e abreviaes............................................................................................... 5 1.2 Descrio........................................................................................................................................ 6 1.3 Diagrama de Caso de Uso............................................................................................................ 7 2. Caso de Uso USART Modo 0 Recepo............................................................................................ 8 2.1 Descrio........................................................................................................................................ 8 2.2 Diagrama de Caso de Uso............................................................................................................ 9 3. Caso de Uso USART Modo 1 Transmisso..................................................................................... 10 3.1 Descrio...................................................................................................................................... 10 3.2 Diagrama de Caso de Uso.......................................................................................................... 11 4. Caso de Uso USART Modo 1 Recepo.......................................................................................... 12 4.1 Descrio...................................................................................................................................... 12 4.2 Diagrama de Caso de Uso.......................................................................................................... 13 5. Caso de Uso USART Modo 2 Transmisso..................................................................................... 14 5.1 Descrio...................................................................................................................................... 14 5.2 Diagrama de Caso de Uso.......................................................................................................... 15 6. Caso de Uso USART Modo 2 Recepo.......................................................................................... 16 6.1 Descrio...................................................................................................................................... 16 6.2 Diagrama de Caso de Uso......................................................................................................... 17 7. Caso de Uso USART Modo 3 Transmisso..................................................................................... 18 7.1 Descrio...................................................................................................................................... 18 7.2 Diagrama de Caso de Uso.......................................................................................................... 19 8. Caso de Uso USART Modo 3 Recepo.......................................................................................... 20 8.1 Descrio...................................................................................................................................... 20 8.2 Diagrama de Caso de Uso......................................................................................................... 21 9. Referncias....................................................................................................................................... 22 [1] Documento de Requisitos; Documento de Especificao de Requisitos do Micro-controlador 8051, http://www.brazilip.org/fenix/projetos/8051/docs/BrazilIP_Requisitos_8051.doc;..................22
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[2] MCS-51 Microcontroller Family User Manual; Nmero 272383-002; fevereiro de 1994; Intel Corporation, em: http://www.cin.ufpe.br/~msml/especificacao/datasheet/intel_8051_27238302.pdf; ................................................................................................................................................................ 22 [3] Data Sheet 80C51 8-bit microcontroller family, 24 de Janeiro de 2003, Philps Semiconductors, em: http://www.cin.ufpe.br/~msml/especificacao/datasheet/P80C3XX2_8XC5XX2_6_datasheet.pdf; ................................................................................................................................................................ 22 [4] The 8051 Microcontroller, Third Edition, Prentice Hall, I. Scott MacKenzie............................. 22 [5] The 8051 Microcontroller, 1997, West Publishing Company, Kenneth J. Ayala........................22
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Esta subseo explica o conceito de alguns termos importantes que sero mencionados no decorrer deste documento. Estes termos so descritos na tabela a seguir, estando apresentados por ordem alfabtica.
Termo Descrio
Baud rate Ciclo (de clock) de recepo Ciclo (de clock) de transmisso Phase RB8 REN RI RXD State SBUF
Taxa de transferncia da USART. Perodo para receber um bit. Determinado pela baud rate. Perodo para transmitir um bit. Determinado pela baud rate. Linha de entrada que indica em qual fase do estado a CPU est. H duas fases possveis: P1 e P2. (Vide especificao da CPU) Bit pertencente ao registrador SCON. Nono bit recebido nos modos 2 e 3. No modo 1 recebe o stop bit. Bit pertencente ao registrador SCON. Bit que habilita a recepo de dados. Bit pertencente ao registrador SCON. Flag de interrupo de recepo. Linha de transmisso/recepo de dados no modo 0. Linha de recepo de dados nos modos 1, 2 e 3. Linha de entrada que indica em qual estado a CPU est. H seis estados possveis: S1, S2, S3, S4, S5 e S6. (Vide especificao da CPU) Registrador que mapeia os registradores de transmisso e recepo. Escrever em SBUF prepara o dado para transmisso. Ler de SBUF recupera o dado recebido. Fisicamente, composto de dois registradores diferentes. O de transmisso s utilizado para escrita e o de recepo s utilizado para leitura. Registrador endereado a bit que contm bits de status e bits de controle. Ciclo de recepo dividido por 16. Bit pertencente ao registrador SCON. Bit 0 de seleo do modo de
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operao. SM1 SM2 SMOD Start bit Stop bit TB8 TI TXD Write_to_SBUF Bit pertencente ao registrador SCON. Bit 1 de seleo do modo de operao. Bit pertencente ao registrador SCON. Bit 2 de seleo do modo de operao. Bit pertencente ao registrador PCON. Quando tem o valor 1 a baud rate dos modos 1, 2 e 3 dobrada. No utilizado no modo 0. Bit que indica o incio da transferncia. Tem sempre o valor 0. Bit que indica o trmino da transferncia. Tem sempre o valor 1. Bit pertencente ao registrador SCON. Nono bit a ser transmitido nos modos 2 e 3. Bit pertencente ao registrador SCON. Flag de interrupo de transmisso. Linha de transmisso/recepo de clock no modo 0. Linha de transmisso de dados nos modos 1, 2 e 3. Linha de entrada que indica quando alguma instruo realiza uma escrita no registrador SBUF. Utilizada para iniciar a transmisso em todos os modos de operao da USART.
1.2
Descrio
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3. Os dados que esto no registrador SBUF so transmitidos pela linha RXD1, um bit por vez, a partir do bit menos significativo, em cada ciclo de transmisso. Cada bit deve ser transmitido pela liha RXD em S6P2 do ciclo de mquina correspondente. 4. Ao final da transmisso do byte de dados, T1 setado para 1. 5. Encerra-se este caso de uso
1.3
Envi _bis_de_dados ar t
bi_envi t ado
Como ambas as linhas RXD e TXD so utilizadas tanto na transmisso quanto na recepo no modo 0, caso se tente transmitir e receber simultaneamente nada pode ser garantido e o resultado imprevisvel. funo do programador garantir que tal condio no ocorra.
1
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Pr-condies: SM2 deve ter o valor 0. Ps-condies: RI tem o valor 1. O dado recebido est no registrador SBUF.
Como ambas as linhas RXD e TXD so utilizadas tanto na transmisso quanto na recepo no modo 0, caso se tente transmitir e receber simultaneamente nada pode ser garantido e o resultado imprevisvel. funo do programador garantir que tal condio no ocorra.
2
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2.2
bi_r t ecebi do
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3.2
st t t ar_bi_envi ado
nono_bi envi t _ ado bi_envi t ado U SAR T m odo de oper ao 1 tansm i r sso
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Pr-condies: REN deve ter o valor 1; Ps-condies: Depende dos eventos ocorridos no passo 5 do fluxo de eventos principal;
1. Este caso de uso inicia quando a USART setada para o modo 1 (SM0 tem o valor 0 e SM1 tem o valor 1), o qual assncrono. Neste modo de operao, ela funciona como uma UART de 8 bits, e a baud rate varivel de acordo com a freqncia de overflow do Timer 1 do 8051. Caso SMOD tenha o valor 0 a baud rate ser de 1/32 da freqncia de overflow do Timer 1 do 8051, caso SMOD tenha o valor 1 a baud rate ser de 1/16 da freqncia de overflow do Timer 1 do 8051. O ciclo de recepo dividido em 16 slots de tempo. 2. A recepo se inicia quando h uma transio de nvel lgico alto para nvel lgico baixo em RXD. Neste momento inicia-se a contagem dos 16 slots. 3. H um mecanismo de eliminao de rudo, utilizado na recepo dos bits da linha RXD, que consiste em obter trs amostras do bit recebido na linha RXD nos slots de tempo de nmero 7, 8 e 9. O valor considerado o que aparecer em no mnimo duas das trs amostras. O primeiro bit (start bit) recebido e caso seu valor no seja o esperado (o valor 0), ele considerado invlido e assume-se que a recepo foi iniciada por um rudo, retornando-se ao passo 1. 4. Nos prximos 8 ciclos de recepo, so recebidos 8 bits de dados pela linha RXD, um em cada ciclo, comeando pelo bit menos significativo. 5. No ciclo de recepo seguinte, o dcimo bit (stop bit) recebido em RXD. Caso as seguintes condies sejam vlidas, SBUF recebe os oito bits de dados recebidos, RB8 recebe o valor do dcimo bit recebido (stop bit) e RI recebe o valor 1: 1) RI tem o valor 0; 2) SM2 tem o valor 1 e o dcimo bit recebido tem o valor 1, ou SM2 tem o valor 0. Neste ponto, independentemente de as condies terem sido satisfeitas ou no, a USART retorna para o passo 1, encerrando este caso de uso.
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4.2
i o n ci
r ni i ei c a descara_dados t
Caso ( I e SM 2=0)o R =0 u ( I e SM 2=1 e o R =0 dci o bi r m t ecebi do i guala ' ) set R I 1', a =1, gr ava o dci o bi m t r ecebi do em R B8 e gr ava o byt r e ecebi n do o SBU F
gr ava_dados
R ecebe_st op_bi_e_checa t
Gr ava_dados
bi_r t ecebi do
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st t t ar_bi_envi ado
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Pr-condies: REN deve ter o valor 1; Ps-condies: Depende dos eventos ocorridos no passo 5 do fluxo de eventos principal;
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i o n ci
r ni i ei c a descara_dados t
Caso ( I e SM 2=0)o R =0 u ( I e SM 2=1 e o R =0 nono bi de dados t r ecebi i do guala ' ) 1', set R I gr a =1, ava o nono bi de dados em R B8 e t gr ava o byt r e ecebi n do o SBU F
gr ava_dados
R ecebe_st op_bi_e_checa t
Gr ava_dados
bi_r t ecebi do
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st t t ar_bi_envi ado
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Pr-condies: REN deve ter o valor 1; Ps-condies: Depende dos eventos ocorridos no passo 5 do fluxo de eventos principal;
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i o n ci
r ni i ei c a descara_dados t
Caso ( I e SM 2=0)o R =0 u ( I e SM 2=1 e o R =0 nono bi de dados t r ecebi i do guala ' ) 1', set R I gr a =1, ava o nono bi de dados em R B8 e t gr ava o byt r e ecebi n do o SBU F
gr ava_dados
R ecebe_st op_bi_e_checa t
Gr ava_dados
bi_r t ecebi do
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9. Referncias
[1] Documento de Requisitos; Documento de Especificao de Requisitos do Micro-controlador 8051, http://www.brazilip.org/fenix/projetos/8051/docs/BrazilIP_Requisitos_8051.doc; [2] MCS-51 Microcontroller Family User Manual; Nmero 272383-002; fevereiro de 1994; Intel Corporation, em: http://www.cin.ufpe.br/~msml/especificacao/datasheet/intel_8051_27238302.pdf; [3] Data Sheet 80C51 8-bit microcontroller family, 24 de Janeiro de 2003, Philps Semiconductors, em: http://www.cin.ufpe.br/~msml/especificacao/datasheet/P80C3XX2_8XC5XX2_6_datasheet.pdf; [4] The 8051 Microcontroller, Third Edition, Prentice Hall, I. Scott MacKenzie [5] The 8051 Microcontroller, 1997, West Publishing Company, Kenneth J. Ayala
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